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  1. test_ddr3

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  2. 基于XILINX K7系列FPGA实现5120*5120分辨率20帧的DDR3读写，发送到海思3559,HDMI显示。(Based on Xilinx K7 series FPGA to achieve 5120*5120 resolution of 20 frames of DDR3 read and write, sent to the Hays 3559,HDMI display.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2021-04-10
    • 文件大小：6144
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