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  1. IRQ

    0下载:
  2. 本程序是关于中断功能的。是IRQ中断。不错哦-irq
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-10
    • 文件大小:708
    • 提供者:薛志雄
  1. AD

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  2. AD采集数据驱动程序 ,用流水灯显示,使用时只需更改单片机拐角-AD data acquisition driver, light show with water, the use of single-chip microcomputer can be changed when the corner
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-01
    • 文件大小:708
    • 提供者:allen
  1. 595led

    0下载:
  2. 利用74HC595实现了简单的跑马灯,74HC595主要实现了串口输入并口输出的作用,还有移位的功能.-74HC595 achieved using a simple ticker
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-07
    • 文件大小:708
    • 提供者:Ricky
  1. ad0809

    0下载:
  2. CPLD+MCU电压采集系统 测试程序-CPLD+ MCU voltage acquisition system
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-11
    • 文件大小:708
    • 提供者:cumtstone
  1. vhdl

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  2. 慢码的vhdl,编码,解码,现在在做一个红外线的project.RC5 生成一个信号个给检测器,检测器会产生一组14 bits的数据流(是一组 曼彻斯特编码)。想用VHDL做一个解码器。-Slow code vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:707
    • 提供者:hm
  1. stoppsignal

    0下载:
  2. A VHDL module that counts long pulses on the inport counting rising edges.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:707
    • 提供者:safe_cpu
  1. cic_interp_8_three

    0下载:
  2. cic_interp_8_three,是产生三级cic差值滤波器-cic_interp_8_three, the difference is to produce three cic filter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:707
    • 提供者:笙箫
  1. traffic-lights-

    0下载:
  2. 交通灯-双向六车道基于Proteus_仿真-Two-way traffic lights in the six traffic lanes
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-26
    • 文件大小:707
    • 提供者:linliyi
  1. Desktop

    0下载:
  2. 用MATLAB产生FFT的变化 以最简单的方式实现-FFT using MATLAB changes produced in the most simple way to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:707
    • 提供者:崔专家
  1. keyboard_QuDou

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  2. 基于EDA技术的键盘控制系统设计的VHDL程序-Keyboard based on EDA technology VHDL process control system design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:707
    • 提供者:hunaigang
  1. ddr3_controller1

    0下载:
  2. ddr3 controller for axi interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:707
    • 提供者:ashu
  1. Train_5

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  2. 在数据段longdata中存放32位二进制无符号数(低位在前),将该变量以16进制形式显示输出-display a 32 bits data with hex formate
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-10
    • 文件大小:707
    • 提供者:李卓函
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