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文件名称:ex1_clkdiv

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [C/C++] [源码]
  • 上传时间：
    2016-01-04
  • 文件大小：
    492.42kb
  • 已下载：
    0次
  • 提 供 者：
    贺****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

这个实验可以说是verilog入门最基础的实验了，我们不做太多的理论分析，实践是硬道理。 当CPLD的I/O（ FM）为低电平时，三极管导通， 蜂鸣器发声。-This experiment can be said to be the most basic experiments verilog entry, and we do not do a lot of theoretical analysis, practice is the last word. When the CPLD' s I/O (FM) is low, the transistor is turned on, the buzzer sounds.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

ex1_clkdiv/clkdivverilog/.sopc_builder/install.ptf
ex1_clkdiv/clkdivverilog/clkdiv.asm.rpt
ex1_clkdiv/clkdivverilog/clkdiv.cdf
ex1_clkdiv/clkdivverilog/clkdiv.done
ex1_clkdiv/clkdivverilog/clkdiv.eda.rpt
ex1_clkdiv/clkdivverilog/clkdiv.fit.rpt
ex1_clkdiv/clkdivverilog/clkdiv.fit.smsg
ex1_clkdiv/clkdivverilog/clkdiv.fit.summary
ex1_clkdiv/clkdivverilog/clkdiv.flow.rpt
ex1_clkdiv/clkdivverilog/clkdiv.jdi
ex1_clkdiv/clkdivverilog/clkdiv.map.rpt
ex1_clkdiv/clkdivverilog/clkdiv.map.summary
ex1_clkdiv/clkdivverilog/clkdiv.pin
ex1_clkdiv/clkdivverilog/clkdiv.pof
ex1_clkdiv/clkdivverilog/clkdiv.qpf
ex1_clkdiv/clkdivverilog/clkdiv.qsf
ex1_clkdiv/clkdivverilog/clkdiv.qws
ex1_clkdiv/clkdivverilog/clkdiv.sof
ex1_clkdiv/clkdivverilog/clkdiv.sta.rpt
ex1_clkdiv/clkdivverilog/clkdiv.sta.summary
ex1_clkdiv/clkdivverilog/clkdiv.tan.rpt
ex1_clkdiv/clkdivverilog/clkdiv.tan.summary
ex1_clkdiv/clkdivverilog/clkdiv.v
ex1_clkdiv/clkdivverilog/clkdiv_assignment_defaults.qdf
ex1_clkdiv/clkdivverilog/db/clkdiv.(0).cnf.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.(0).cnf.hdb
ex1_clkdiv/clkdivverilog/db/clkdiv.asm.qmsg
ex1_clkdiv/clkdivverilog/db/clkdiv.asm.rdb
ex1_clkdiv/clkdivverilog/db/clkdiv.asm_labs.ddb
ex1_clkdiv/clkdivverilog/db/clkdiv.cbx.xml
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp.bpm
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp.hdb
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp.idb
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp.kpt
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp.logdb
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp.rdb
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp0.ddb
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp1.ddb
ex1_clkdiv/clkdivverilog/db/clkdiv.cmp_merge.kpt
ex1_clkdiv/clkdivverilog/db/clkdiv.db_info
ex1_clkdiv/clkdivverilog/db/clkdiv.eda.qmsg
ex1_clkdiv/clkdivverilog/db/clkdiv.fit.qmsg
ex1_clkdiv/clkdivverilog/db/clkdiv.hier_info
ex1_clkdiv/clkdivverilog/db/clkdiv.hif
ex1_clkdiv/clkdivverilog/db/clkdiv.ipinfo
ex1_clkdiv/clkdivverilog/db/clkdiv.lpc.html
ex1_clkdiv/clkdivverilog/db/clkdiv.lpc.rdb
ex1_clkdiv/clkdivverilog/db/clkdiv.lpc.txt
ex1_clkdiv/clkdivverilog/db/clkdiv.map.ammdb
ex1_clkdiv/clkdivverilog/db/clkdiv.map.bpm
ex1_clkdiv/clkdivverilog/db/clkdiv.map.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.map.hdb
ex1_clkdiv/clkdivverilog/db/clkdiv.map.kpt
ex1_clkdiv/clkdivverilog/db/clkdiv.map.logdb
ex1_clkdiv/clkdivverilog/db/clkdiv.map.qmsg
ex1_clkdiv/clkdivverilog/db/clkdiv.map.rdb
ex1_clkdiv/clkdivverilog/db/clkdiv.map_bb.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.map_bb.hdb
ex1_clkdiv/clkdivverilog/db/clkdiv.map_bb.logdb
ex1_clkdiv/clkdivverilog/db/clkdiv.pplq.rdb
ex1_clkdiv/clkdivverilog/db/clkdiv.pre_map.hdb
ex1_clkdiv/clkdivverilog/db/clkdiv.pti_db_list.ddb
ex1_clkdiv/clkdivverilog/db/clkdiv.root_partition.map.reg_db.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.routing.rdb
ex1_clkdiv/clkdivverilog/db/clkdiv.rtlv.hdb
ex1_clkdiv/clkdivverilog/db/clkdiv.rtlv_sg.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.rtlv_sg_swap.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.sgdiff.cdb
ex1_clkdiv/clkdivverilog/db/clkdiv.sgdiff.hdb
ex1_clkdiv/clkdivverilog/db/clkdiv.sld_design_entry.sci
ex1_clkdiv/clkdivverilog/db/clkdiv.sld_design_entry_dsc.sci
ex1_clkdiv/clkdivverilog/db/clkdiv.smart_action.txt
ex1_clkdiv/clkdivverilog/db/clkdiv.sta.qmsg
ex1_clkdiv/clkdivverilog/db/clkdiv.sta.rdb
ex1_clkdiv/clkdivverilog/db/clkdiv.sta_cmp.6_slow.tdb
ex1_clkdiv/clkdivverilog/db/clkdiv.syn_hier_info
ex1_clkdiv/clkdivverilog/db/clkdiv.tis_db_list.ddb
ex1_clkdiv/clkdivverilog/db/clkdiv.tmw_info
ex1_clkdiv/clkdivverilog/db/clkdiv.vpr.ammdb
ex1_clkdiv/clkdivverilog/db/logic_util_heursitic.dat
ex1_clkdiv/clkdivverilog/db/prev_cmp_clkdiv.asm.qmsg
ex1_clkdiv/clkdivverilog/db/prev_cmp_clkdiv.fit.qmsg
ex1_clkdiv/clkdivverilog/db/prev_cmp_clkdiv.map.qmsg
ex1_clkdiv/clkdivverilog/db/prev_cmp_clkdiv.qmsg
ex1_clkdiv/clkdivverilog/db/prev_cmp_clkdiv.tan.qmsg
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.db_info
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.cmp.ammdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.cmp.cdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.cmp.dfp
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.cmp.hdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.cmp.kpt
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.cmp.logdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.cmp.rcfdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.map.cdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.map.dpi
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.map.hbdb.cdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.map.hbdb.hb_info
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.map.hbdb.hdb
ex1_clkdiv/clkdivverilog/incremental_db/compiled_partitions/clkdiv.root_partition.map.h

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