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文件名称:counter

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Text]
  • 上传时间：
    2012-10-23
  • 文件大小：
    1.8kb
  • 已下载：
    1次
  • 提 供 者：
    王***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

关于FPGA实现的几种计数器的verilog源程序-FPGA implementation of several counter verilog source code
相关搜索： FPGA counter

(系统自动生成,下载前可以参看下载内容)

下载文件列表

Verilog源码/10进制减法计数器.txt
Verilog源码/24进制计数器.txt
Verilog源码/8位约翰计数器.txt
Verilog源码/8进制计数器.txt
Verilog源码/可预置可循环的加减计数器.txt
Verilog源码

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