文件名称:1bitled
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SSI对从外设器件接收到的数据执行串行到并行转换。CPU可以访问SSI数据寄存器来发送和获得数据。发送和接收路径利用内部FIFO存储单元进行缓冲,以允许最多8个16位的值在发送和接收模式中独立地存储。
使用 ssi 控制1位数码管的显示-SSI received from peripheral devices to the implementation of the serial to parallel data conversion. CPU can access data register SSI to send and receive data. Send and receive path to use the internal FIFO buffer memory unit to allow a maximum of eight 16-bit value in the send and receive mode, an independent store.
使用 ssi 控制1位数码管的显示-SSI received from peripheral devices to the implementation of the serial to parallel data conversion. CPU can access data register SSI to send and receive data. Send and receive path to use the internal FIFO buffer memory unit to allow a maximum of eight 16-bit value in the send and receive mode, an independent store.
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