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TalkToCar-mcu
- 用Keil编写的在STC12C5410AD单片机端使用的程序，通过UART转232通讯接收来自PC串口的控制信号，实现电动小车特定PWM、前进、后退等动作响应，这个是在单片机下运行的程序，PC端程序请看“TalkToCar-PC”
LFH_MFSK
- 慢速跳频，调制样式为MFSK(MFSK/FH)，包括信号的发射接收模型，自己写的代码，仅供参考。
LFH_DPSK
- 慢速跳频，调制样式为DPSK(DPSK/FH)，包括信号的发射接收模型，自己写的代码，仅供参考。
SFH_MFSK
- 高速跳频，调制样式为MFSK(MFSK/FH)，包括信号的发射接收模型，自己写的代码，仅供参考。
SFH_DPSK
- 高速跳频，调制样式为DPSK(DPSK/FH)，包括信号的发射接收模型，自己写的代码，仅供参考。
Alamouti
- 主函数Alamouti(Nr,max_snr,max_err_symbol,symbol_per_frame) 调用函数QpskMapping(psudo_bit_sequence)－－二进制数据到QPSK信号的变换 调用函数RayleighCH(Nr,Nt)－－瑞利衰落信道模拟 仿真示例： Alamouti(1,12,20,24) 说明： 1.2根发射天线、1根接收天线 2.最高信噪比为12dB，即仿真范围为0dB到12dB 3.在每个信噪比
999
- 根据有无固定基础设施，无线局域网又可分为BSS (Basic Service Set)和IBSS (Independent Basic Service Set)。我们要研究的ad hoc网络属于后者。假设在一个ad hoc网络中，移动节点的发射功率PTx总是恒定的。要发送数据的移动节点总是先监听信道，测量接收到的信号功率X，其中X= I + N, I为接收到的干扰，N是噪声。移动节点只有在X＜INThre时，才可以发射。式中，INThre为背景噪声门限。 在仿真中，我们规定每个移动节点的发射
ps2
- PS/2 键盘鼠标通信实验。学习PS/2的传输协议，利用实验板上的PS/2接口，实现键盘，鼠标与实验板间的数据通信，并且将从键盘，鼠标接收到的信号解码后通过LCD进行显示。
trt
- 串口通信 接收GPRS信号 显示在显示LED上 LED显示屏 还没解决
system_timing_theory
- 对于系统设计工程师来说，时序问题在设计中是至关重要的，尤其是随着时钟频率的提高，留给数据传输的有效读写窗口越来越小，要想在很短的时间限制里，让数据信号从驱动端完整地传送到接收端，就必须进行精确的时序计算和分析。同时，时序和信号完整性也是密不可分的，良好的信号质量是确保稳定的时序的关键
adhoc
- 在仿真中，我们规定每个移动节点的发射功率是常数，PTx = 1W；接收节点接收机的灵敏度Smin = -80 dBm；信号质量 min = 2 dB；系统的背景噪声门限INThre = 1.2e-10
tuner.c
- tuner0299实现对卫星信号的接收用于解码 的输入
communcation
- 基于Matlab语言的现代通信仿真分析,仿真实现了主要模块二进制信息源输入，16QAM调制，发射滤波器，接收滤波器，采样，均衡，信号检测，16QAM解调，信息还原输出，产生BER曲线图。
task
- 练习并掌握多任务实时操作系统下Task 调度、Task 间主要通信手段（信号量、消息队列等）、RISC 处理器 I/O 端口控制等内容，并形成嵌入式实时应用软件的良好编程习惯。创建多Task，为每个Task 创建私有的Message Queue，每个Task 只通过自己的私有Message Queue 接收消息；Task 间消息通信通过向对方私有MessageQueue 发送消息完成。 Task1：管理Task。负责系统启动时同步系统中其他Task 的启动同步，利用信号量的semFlush(
DemoCode
- 主要供用户进行学习和简单设计，功能如下： 可以测量温度； 可以测量光线状况； 可以进行障碍检测； 可以接收来自遥控器的信号； 可以模拟简易遥控器。
PPMreceiver
- 主要是用于脉冲位置调制当中接收端接收信号的产生
KeyTechnologyofDVBH
- 新一代的多媒体移动标准DVB—H是DVB—T在移动接收方面的扩展。针对移动接收的特点，DVB—H 提出 了几项颇受瞩目的新技术，实现了对手机等手持式移动终端接收地面数字广播电视信号的良好支持。包括降低能耗、无缝切 换、提高移动环境中的抗干扰能力以及灵活的组网方案等。介绍了DVB—H的系统结构，详细讨论了DVB—H标准中数据 链路层的时间分片(time slicing)和多协议封装一前向纠错(MPE—FEC)技术，并给出一些实验环境下的定量分析。
Mov9
- 本工程实现的是9位义位与串并变换模块 具体工作过程是： 在时钟CLK的上升沿触发下，从inp端输入接收m序列，按顺序inp->A9->A8->...->A0进行意味，同时把A9，A8，...A0的输出分别给B9，B8，B7,...从而完成串并转换的功能。Q端的信号取自A0的输出短，作为一位4位后的串行m序列信号。 clk为输入时钟信号；inp为接收序列信号输入；Q为串行序列输出；B0~B3为四位并行序列输出。
fldc_d_4_as
- 基于分数低阶协方差仿真的时延估计问题，其基本思想是利用两个接收信号的相关函数来估计时间延迟。
wireless
- 无线收发芯片nRF2401三个发送节点，一个接收节点，并且加入了应答信号。