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搜索资源列表

  1. shuzizhong

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  2. 大学VHDL实验数字钟源码,有的专业数字电路实验设计也有要求做的。-University of VHDL experimental digital clock source, and some professional digital circuit design has also requested to do so.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:515
    • 提供者:史善爽
  1. dds

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  2. 改程序是用ds18b20,lcd-1602,89c51做的一个代有闹钟的数字钟,并有书签和音乐,非常漂亮!-Change procedures are used ds18b20, lcd-1602, 89c51 make a generation of the digital clock has an alarm clock, and there is a bookmark and music, very beautiful!
  3. 所属分类:SCM

    • 发布日期:2017-04-11
    • 文件大小:1451
    • 提供者:史航伟
  1. c51shuzizhong

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  2. 用汇编语言编写的数字钟程序。单片机89c51.-Language used to compile digital clock procedures. Single-chip 89c51.
  3. 所属分类:assembly language

    • 发布日期:2017-04-29
    • 文件大小:102416
    • 提供者:王磊
  1. matlabclock

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  2. 一个用matlab编写的时钟程序,包含了数字钟和传统显示的圆形中,背景是可爱图片。运行时和电脑同步。-a program on a clock which contains a traditional clock and a numerical one,with a lovely background picture。when the program runs ,the clock will keep the pace with the correct time of the computer。
  3. 所属分类:matlab

    • 发布日期:2017-05-02
    • 文件大小:662960
    • 提供者:陈高翔
  1. szz

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  2. 该文件是用VHDL变成实现的数字钟程序,请指教!-The document is a VHDL implementation of the digital clock into the procedure, please advise!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:135974
    • 提供者:张友钟
  1. jm

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  2. 简易数字钟: 采用分成次设计,实现时分秒显示,下载到CYLONE 在线编程版上 用试验箱的七段译码管显示-Simple digital clock: The time is divided into the design, implementation, when minutes and seconds display, download to online programming CYLONE chamber version on the Seven-Segment Decoder w
  3. 所属分类:assembly language

    • 发布日期:2017-04-27
    • 文件大小:249699
    • 提供者:柯南
  1. digtal

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  2. 时、分、秒、实现数字钟的基本VHDL源代码。-Digital clock basic VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1969
    • 提供者:jm2005
  1. Quartus_Clock

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  2. 利用Quartus模块化层次化设计数字钟-Using Quartus hierarchical modular design digital clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:9649
    • 提供者:hievery1
  1. EDA36

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  2. 数字钟的设计,实现正点报时的系统!-Digital clock design, punctual implementation of the system time !.......
  3. 所属分类:assembly language

    • 发布日期:2017-04-26
    • 文件大小:100267
    • 提供者:刚刚
  1. clock

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  2. 实现小型数字钟,欢迎大家使用。主要实现闹钟,四位led的数字钟.-Implementation of small digital clock, welcome everyone to use. Main alarm clock, led digital clock 4.
  3. 所属分类:SCM

    • 发布日期:2017-04-28
    • 文件大小:13692
    • 提供者:曾忍
  1. hardware

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  2. 本程序是数字钟的单片机汇编程序,可供大家参考。-This procedure is the single-chip digital clock assembler for your reference.
  3. 所属分类:assembly language

    • 发布日期:2017-04-15
    • 文件大小:5647
    • 提供者:徐伟业
  1. clock

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  2. 数字钟的verilog程序,很经典,大家可以看看。-Verilog digital clock procedures, it is a classic, we will look at.
  3. 所属分类:assembly language

    • 发布日期:2017-04-15
    • 文件大小:7257
    • 提供者:谢桂辉
  1. io

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  2. 基于MSC51的数字钟。采用PCF8563作为日历芯片,ZLG7290显示和键盘控制。具有5个闹钟源。同时可以修改报时时间和报时音效和LED灯效。-MSC51-based digital clock. PCF8563 chip used as a calendar, ZLG7290 display and keyboard control. Clock source has a 5. At the same time, time can be amended time and time effi
  3. 所属分类:SCM

    • 发布日期:2017-04-07
    • 文件大小:1981
    • 提供者:plzou
  1. shizhong

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  2. 数字钟的VHDL源程序,可以实现校时,校分等功能,并在试验箱上运行成功-The VHDL source code digital clock, you can achieve at school, school grade features, and success in the chamber is running on
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:310103
    • 提供者:zhaozheng
  1. shi

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  2. 数字钟的VHDL源程序,可以实现校时,校分等功能,并在试验箱上运行成功-The VHDL source code digital clock, you can achieve at school, school grade features, and success in the chamber is running on
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:309293
    • 提供者:zhaozheng
  1. shizhong

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  2. 此代码为89c51的汇编语言,他是一个数字钟程序,可实现秒分时的计时-This code for the 89c51 assembly language, he is a digital clock procedures, can be time-seconds time
  3. 所属分类:SCM

    • 发布日期:2017-04-13
    • 文件大小:2222
    • 提供者:毛小
  1. 11

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  2. 阵显示的数字钟   IC卡电表设计   校园一卡通系统的设计与实现   遥控编码电子锁   2G频率计的设计   具有语音功能的超声波测距系统   数字FM接收机   温度远程测控系统  -AAAAABBBBBBBBBBBBBVVVVVVVVVVVVVVVVVV
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:554
    • 提供者:王兵
  1. digital_clock

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  2. 该数字钟可实现精度误差≤ 1S/天的变精度时钟,并能方便地调节时钟、时间、定时时间等,秩序结构清晰,一看即懂,还可以配编附加一些功能如计数器功能等(扩展键盘)-The digital clock can be achieved precision of ≤ 1S/day variable precision clock, and can easily adjust the clock, time, regular time, the order of structure clear, a loo
  3. 所属分类:SCM

    • 发布日期:2017-04-14
    • 文件大小:4032
    • 提供者:yxp
  1. EDAtest

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  2. 关于数字钟的实现,用VHDL实现时,分,秒,的显示,并能报时-Digital clock on the realization of VHDL to achieve with hour, minute, seconds display, and time
  3. 所属分类:assembly language

    • 发布日期:2017-04-03
    • 文件大小:170660
    • 提供者:dulianjie1
  1. clock

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  2. 该程序是实现数字钟的实现 ,并且有相应的界面。-The program is to achieve the realization of digital clock, and a corresponding interface.
  3. 所属分类:assembly language

    • 发布日期:2017-04-28
    • 文件大小:363337
    • 提供者:古小将
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