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搜索资源列表

  1. WinRAR

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  2. 数字钟是用单片机技术和数模电路基础知识实现的电子钟。-Digital Clock is a digital to analog circuit using microcontroller technology to achieve basic knowledge of the electronic clock.
  3. 所属分类:SCM

    • 发布日期:2017-05-04
    • 文件大小:1404925
    • 提供者:肖翔宇
  1. shuzizhong

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  2. 基于VHDL的数字钟,可以整点报时和校准时间-VHDL CPLD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:431458
    • 提供者:hu
  1. shuizhiong

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  2. 一个多功能数字钟,四个按键控制,可以对小时和分钟进行修改,且有闹钟和秒表功能-A multi-functional digital clock, four control buttons, you can make changes to the hours and minutes, and there is alarm and stopwatch functions 朗读显示对应的拉丁字符的拼音
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:25343
    • 提供者:
  1. DIGITAL_CLOCK_TEST

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  2. 数字钟的FPGA实验,挺好用的,修改了一般代码的频闪问题,时间不准的问题,应用于CYLONE2平台及外借数码管-Digital clock FPGA experiments, very good use, modify the general code of strobe, time allowed to question, and the loan application CYLONE2 digital platform
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:3777
    • 提供者:simon greenhall
  1. miao

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  2. 数字钟 电子信息工程专业 EDA课程设计 管脚已经分配-Digital clock Electronic and Information Engineering course design pin has been assigned EDA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:7681183
    • 提供者:zheng yanyang
  1. multifunction-digital-clock

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  2. easyARM1138多功能数字钟源代码-the source codes of multifunctional digital clock based on easyARM1138
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-27
    • 文件大小:88435
    • 提供者:梦中华彩
  1. EDAshejijianggao2008

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  2. EDA设计是演讲稿有关数字钟 ,结合实验箱-EDA design is a speech about digital clock, combined with experimental box
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2061113
    • 提供者:shimaomao
  1. shuzizhong

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  2. 单片机做的数字钟,包含K51部分,proteus仿真部分,记电路图-Microcontroller to do digital clock, including K51 parts, proteus simulation part of the record circuit
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:86061
    • 提供者:liuguang
  1. DPJ

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  2. 基于8051单片机的数字钟[附图+源码+中英文文献]-8051-based Digital Clock [photo+ source+ in English literature]
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:215709
    • 提供者:ouyang
  1. clock

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  2. vhdl 简易数字钟 基于fpga 使用quartus7.0,便于移植到其他平台
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1436739
    • 提供者:king
  1. watch

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  2. 本文件为电子设计而开发的多功能数字钟VHDL语言完整源代码 --该数字钟实现的功能有时间,秒表,闹钟,年月日的显示设置等 -This document is multi-functional electronic design and development of a complete VHDL, digital clock source code- the digital clock function can be achieved time, stopwatch, alarm clo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:526451
    • 提供者:钟祥
  1. aclock

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  2. 一个verilog的经典实例,即智能化的数字钟-an example of verilog,a clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:4160
    • 提供者:魏颖
  1. candh

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  2. 数字钟具有时、分、秒的显示、调整、清零功能,采用的时间制式为24小时制,时间显示格式为时(十位、个位)分(十位、个位)秒(十位、个位),它具有三种工作状态,即系统清零状态、时钟运行状态和时钟调整状态。 数字钟上电或复位后,数字钟自动进入时钟运行状态。此时,按数字钟的时钟调整键(K4),数字钟进入时钟调整状态;在时钟运行状态下,可以利用复位键将计时清零;在时钟调整状态下,可利用键盘上的按键(K3、K2)分别修改时、分、秒的值,修改完毕后按数字钟的调整键(K4),则数字钟又回到时钟运行状态,继续
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:22137
    • 提供者:王奉凯
  1. music1

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  2. VHDL 多功能数字钟源码音乐模块2,自扒简谱-Multi-function digital clock source VHDL music module 2, since the expense of musical notation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1201
    • 提供者:
  1. EDA

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  2. 设计数字钟电路满足以下要求 ○1、具有时,分,秒,计数显示功能,以24小时循环计时。 ○2、具有清零,调节小时、分钟功能。 ○3、具有整点报时功能,整点报时的同时LED灯花样显示。 -Digital clock circuit designed to meet the following requirements ○ 1, with the hours, minutes, seconds, counting display, 24-hour cycle time. ○ 2, wi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:713213
    • 提供者:孙飞飞
  1. Digital-Clock

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  2. 24小时制数字钟,可以简单更改为12小时制-Digital Clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:941
    • 提供者:wanghai
  1. clock

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  2. 多功能数字钟 含闹钟 时间显示 年 月 日 星期 显示温度-duogongneng shuzizhong
  3. 所属分类:SCM

    • 发布日期:2017-04-09
    • 文件大小:71672
    • 提供者:徐佳妃
  1. shuzizhong

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  2. 这个是关于用VHDL语言设计出来数字钟的程序,能够实现最基本的功能,对于想学习VHDL语言的人来说,是一个很好练习的例子。-This is about the design using VHDL, digital clock out of the program, to achieve the most basic functions, for people who want to learn VHDL language, it is a good practice example.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:413924
    • 提供者:李健
  1. topclock

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  2. 基于FPGA的数字钟设计,带有正点报时任意时刻闹钟-Design of FPGA-based digital clock, alarm clock with a punctual timekeeping at any time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1560
    • 提供者:熊天天
  1. SEG7

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  2. 自己设计的数字钟,用6个数码管显示,并且可以调整时间-Digital clock of their own design, with six digital display, and can adjust the time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:739842
    • 提供者:周航
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