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搜索资源列表

  1. clock1

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  2. 本程序用VHDL编写数字钟,具有定点报时,手动调整时间等功能,能下载到板子上显示时间。-This program written by VHDL digital clock, with a fixed broadcast, manually adjust the time and other functions, can be downloaded to display the time on the board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:435703
    • 提供者:zhangshuanglu
  1. clock

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  2. VHDL编程--数字钟 非常适合初学者-VHDL Programming- digital clock is ideal for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5938
    • 提供者:luojie
  1. shuzizhong

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  2. 做的一个数字钟 能显示时分秒,功能齐全,用C语言编写的程序,简单易懂,适合大家学习之用。多多支持-A digital clock can be displayed every second, fully functional, with programs written in C language, easy to understand, for all learning. Generous support
  3. 所属分类:SCM

    • 发布日期:2017-04-02
    • 文件大小:53588
    • 提供者:梁金
  1. clock

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  2. 在FPGA下用VHDL语言设计的数字钟程序-Under the FPGA design using VHDL, digital clock program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:431695
    • 提供者:钟辉泉
  1. jiamshuzihong

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  2. 用8051单片机制作简易数字钟的keil工程文件-Simple digital clock with a single chip made of keil project file
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:61575
    • 提供者:曾露
  1. 3

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  2. 电子数字钟设计实际上是一个对标准频率(1Hz)进行计数的计数电路。振荡器产生的时钟信号经过分频器形成秒脉冲信号,秒脉冲信号输入计数器进行计数,并把累计结果以“时”、“分”、“秒”的数字显示出来。-Electronic digital clock is actually a standard frequency (1Hz) to count the counting circuit. Oscillator clock signal through the divider formed second
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:325171
    • 提供者:wang
  1. clock

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  2. 该程序是用嵌入式开发的一个多功能数字钟,可以实现正常的计时,倒计时,闹钟,始终调整,整点报时功能-The program is the development of a multi-function embedded digital clock, can achieve a normal time, countdown, alarm clock, and always adjusting, the whole point timekeeping function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:66588
    • 提供者:liulingling
  1. timescale-1ns

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  2. 这是一款由晶振产生的脉冲控制的数字钟,可以从00:00:00到23:59:59之间进行计时。-this is a clolk controlled by continuious pulse.it can timing from 00:00:00 to 23:59:59.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:8366
    • 提供者:mxf
  1. shizhong

    0下载:
  2. vhdl描述的数字钟,功能一样,方法不同-vhdl descr iption of the digital clock, the same function, different methods
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1658
    • 提供者:苏杰
  1. shuzizhong

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  2. 《数字钟》的设计。 开机时,显示12:00:00的时间开始计时; P0.0/AD0控制“秒”的调整,每按一次加1秒; P0.1/AD1控制“分”的调整,每按一次加1分; P0.2/AD2控制“时”的调整,每按一次加1个小时; c语言和asm格式都有-" Digital clock" design. Boot, show 12:00:00 time to start timing P0.0/AD0 control " second"
  3. 所属分类:SCM

    • 发布日期:2017-04-06
    • 文件大小:66779
    • 提供者:tianya
  1. watch

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  2. EDA数字钟VHDL的程序,它分多个模块进行,主要是采用VHDL语言而不是Verlog语言-the program for digital clock of EDA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:387919
    • 提供者:petcat
  1. 8952

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  2. 这是一个基于VHDL语言的数字钟设计,它是EDA的一个实例-This is a program for clock ,it is a example for EDA.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:126284
    • 提供者:petcatpetcat
  1. rtl

    0下载:
  2. STOPWATCH,alarm,clock 功能的数字钟-General Digital Clock Clock setting with Switch – Use Key_up and Key_down key to change the number – Use Key_right and Key_left key to change the position – Use set key to start Clock Alarm Function – Use Ala
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:7931
    • 提供者:赵香君
  1. 122

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  2. 1302数字钟的程序 可随意改时间初始值-1302 Digital Clock program can be free to change the time of the initial value
  3. 所属分类:assembly language

    • 发布日期:2017-04-09
    • 文件大小:50519
    • 提供者:林可
  1. digi_clock

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  2. 用verilog写的数字钟程序,已在altera公司的cyclone IV开发板上运行成功,很有价值-Digital clock using verilog written procedures for the company in altera cyclone IV development board to run a successful, valuable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3134276
    • 提供者:jiankang
  1. shuzhizhong

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  2. 数字钟代码,包括原理图和单片机程序代码。原理图为proteus软件仿真的图片-Digital clock code, including schematic and microcontroller code
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:788
    • 提供者:gan
  1. ddd

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  2. 简单的数字钟设计 程序优化设计 适合初学者 能够很好的规范语言的最简性-Simple digital clock design program optimization design
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-06
    • 文件大小:1046
    • 提供者:杨从顺
  1. time

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  2. 数字钟,p0口与1602的数据相连,rs-P3.0,RW-P3.1,EN-P3.2。用timer0 产生1s中断。自定义的ampm标志。 请问高手:“什么时候自制的ampm图形会在38H中呢?为什么指令CPL ACC.0就是改变ampm图形呢?”请高手赐教-Digital clock, p0 port is connected with the 1602 data, rs-P3.0, RW-P3.1, EN-P3.2. 1s generated by timer0 interrupt. Cust
  3. 所属分类:assembly language

    • 发布日期:2017-04-13
    • 文件大小:1581
    • 提供者:姚滨
  1. C-a-digital-clock-program

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  2. C语言数字钟程序,可以运行得到适用的数字时钟-C language digital clock program that can be applied to digital clock running
  3. 所属分类:CSharp

    • 发布日期:2017-03-28
    • 文件大小:579
    • 提供者:李千寻
  1. digitalclock

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  2. 数码管显示8位数字钟,其中 SW18调整小时, SW19调整分钟 ,SW20调整秒-8-bit digital display digital clock, which adjust the hours SW18, SW19 adjust the minutes, SW20 adjust seconds
  3. 所属分类:SCM

    • 发布日期:2017-04-09
    • 文件大小:17593
    • 提供者:hkhl
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