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- xilinx、arm、avr、s52、altera及lattice下载线的原理图和PCB图-xilinx, arm, avr, s52, altera, and lattice download line schematic and PCB diagram
photo_fee_system_code
- 用于altera maxii cpld的电话计费器示例程序和原理图-For the altera maxii cpld telephone meter sample application and schematic
Study_on_Key_Technologies_of_n4-DQPSK_Modulation_a
- 本文首先研究可4一DQPsK调制解调系统中调制部分的基本原理和各个模块的设计方案，重点研究成形滤波器和直接数字频率合成器 (DireetoigitalFrequeneySynihesis，简称DDS)，并针对各个关键模块算法进行matlab设计仿真，展示仿真结果。其次，研究调制解调系统解调部分的基本原理和各个模块的设计方案，重点研究差分解调，数字下变频和位同步算法，也针对其各个关键模块进行算法的Matlab设计仿真。然后用Matlab对整个系统进行理论仿真，得出结论。在此基础 上，采用超高速
DE2_UserManual
- ALTERA公司DE2板子原理图-ALTERA' s DE2 board schematic! ! ! ! ! ! ! ! ! ! ! ! ! ! ! ! ! ! ! ! ! !
C3_F780_HOST
- altera 3C120的原理图。用orcad打开-altera 3C120 schematic. Open with orcad
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cycloneiii_sb_3c25
- 这是ALTERA 公司Cyclone III的Cyclone III的EP3C25的原理图，对于学习FPGA有很大的帮助。-It is very usefull to learner,which learn Cyclone III-EP3C25,It could help you more easier escape it!
cangyongEDAgjzn
- 4.1 Altera MAX+plusⅡ操作指南 4.1.1 MAX+plusⅡ10.2的安装 4.1.2 MAX+plusⅡ开发系统设计入门 4.2 Xilinx ISE Series的使用 4.2.1 ISE的安装 4.2.2 ISE工程设计流程 4.2.3 VHDL设计操作指南 4.2.4 ISE综合使用实例 4.3 Lattice ispDesignEXPERT的使用 4.3.1 ispDesignEXPERT的安装 4.3.2 原理图输入方式设计
EPM240DemoBoard
- ALTERA CPLD EM240开发板原理图及源码-ALTERA CPLD EM240 development board schematics and source code
ep1c6P80c52
- Altera FPGA cyclone EP1C6 + 80C52 实验板原理图-Altera FPGA cyclone EP1C6+ 80C52 Experiment Board Schematic
Max_Plus_II-_tutorial
- Max+plusII(或写成Maxplus2,或MP2) 是Altera公司推出的的第三代PLD开发系统(Altera第四代PLD开发系统被称为：QuartusII，主要用于设计新器件和大规模CPLD/FPGA).使用MAX+PLUSII的设计者不需精通器件内部的复杂结构。设计者可以用自己熟悉的设计工具（如原理图输入或硬件描述语言）建立设计，MAX+PLUSII把这些设计转自动换成最终所需的格式。其设计速度非常快。Maxplus2被公认为是最易使用，人机界面最友善的PLD开发软件，特别适合初学者
EP2C_sch
- Cyclone2开发板原理图。学习Altera必备利器。-Cyclone2 development board schematics. Altera essential learning tool.
ALTERA_USB
- altera usb制作资料 包括原理图软件及硬件程序语言-altera cpld usb Blaster
61EDA_C1113
- Altera公司的关于FPGA设计的资料， 其中包括了硬件的原理图以及相关的软件例程，为大家的学习提供了很好的例子。-Altera company about the FPGA design of material, Including the hardware diagram and related software routines, for all of us study provides a good example.
verilog-HDL-learning
- 从零开始学verilog HDL ，包括Altera实验板原理图，xilinx实验板原理图和一些实验源程序-From scratch learn verilog HDL, including Altera experimental board schematic, xilinx test board schematics and source code of some experiments
DE2_scheamtics
- altera 公司的FPGA 二代板的原理图-DE2_scheamtics from altera company
segments_display_ep2c20f484c7n
- 实现4位数码管秒表显示，有使能，复位的功能，并在altera fpga ep2c20f484c7n上实现，文档里含有，原理图，引脚分配图，代码，及相应的说明，适合入门的朋友。-Achieve four digital stopwatch display, there is enabled, reset functions, and altera fpga ep2c20f484c7n to achieve, the document contains, schematics, Pin Assign
Cyclone-III-FPGA.sch
- Altera官方Cyclone III实验板原理图，可以作为自己的参考设计-Altera Cyclone III test board official schematic diagram can be used as their reference design
debounce_1_Sch
- 用QuartusII原理图形式编写的按键消抖程序,分频产生100Hz的按键采样时钟,采样时钟周期为10ms, 按键按下的时间与产生低电平信号的时间相等,按键按下的时间与LED灯亮的时间相等-*Project Name :debounce_Sch *Module Name :debounce_Sch *Target Device :Any Altera FPGA/CPLD Device *Clkin : 50MHz *Desisgner : zhaibin *D
MAX_II_RevC_brd
- Altera CPLD开发板原理图和PCB -Altera CPLD