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F16Simulation
- 一个F-16仿真程序，可用于一般的飞行器仿真实验．采用了模块化设计．-an F-16 simulation program can be used for general aircraft simulation. Using a modular design.
JS_Library
- C语言程序课程设计实验报告-图书管理系统-C Programming Language Course Design Experiment Report-library management system
fenzhijixunhuanchengxusheji
- 这是一个汇编语言的实验－循环及分支程序设计-This is a compilation of language-branch circulation and program design
simpleEmbeddedWebServer
- 嵌入式系统设计与实例开发实验教程二嵌入式WEB服务器实验-Embedded System Design with examples of the development of two experimental Guide Embedded Web server experiment
ACM1602llcdyejingxianshi
- E=p3^2 RW=p3^3 RS=p3^4 p2口输入 第三管脚电阻2.254k(+)和264(-) 晶振11.0592M 设计者dudongliang 开发平台:自制实验板 设计日期:2006年4月7日-p3 = E ^ 2 = p3 RW RS = 3 ^ ^ 4 p2 p3 mouth third pin input resistance 2.254 k (), and 264 (-) Oscillator 11.0592M designers dudongliang
2005electron_design_contest
- 2005年全国大学生电子设计大赛实验程序 附各个模块以及生成文件-2005 National Undergraduate Electronic Design Contest experimental procedure with each module and document generation
FPGAdigitaltimer
- 本设计要实现一个具有预置数的数字钟的设计,具体要求如下: 1. 正确显示年、月、日 2. 正确显示时、分、秒 3. 具有校时,整点报时和秒表功能 4. 进行系统模拟仿真和下载编程实验,验证系统的正确性 -designed to achieve this with a number of preset clock design, and specific requirements are as follows : 1. Display correctly, , 2. d
edaTimer
- 数字钟的主要功能有年月日时分秒的显示输出功能和对日期及时间进行设置的功能，还可以有整点报时等功能。设计数字钟的核心问题是时钟日期的自动转换功能。即自动识别不同月份的天数的控制。据此可以设计一个如图所示结构的数字钟，该数字钟包括校时模块、月份天数处理模块、时分秒计时模块、年月日模块和输出选择模块。在本实验中，只进行了简单的数字时分秒设计，其他部分还有待下一步改进。-digital clock is the main function Minutes date when the output fun
Digital_signal_Process
- 数字信号处理 各种滤波器的设计，中南大学电子信息工程 大三的课程设计全部源代码和实验报告，欢迎下载！-various digital signal processing filter design, Zhongnan University of Electronics and Information Engineering, the design of the church all of the source code and laboratory reports, download welco
clockdesign
- 基于SMART-I实验平台的时钟电路设计与实现，利用vhdl编程进行仿真，并且下载实现，功能正确-based on SMART - I platform clock circuit design and implementation vhdl use simulation program, and download realization function correctly
NumClock
- 基于Altera公司系列FPGA(Cyclone EP1C3T144C8)、Verilog HDL、MAX7219数码管显示芯片、4X4矩阵键盘、TDA2822功放芯片及扬声器等实现了《电子线路设计• 测试• 实验》课程中多功能数字钟实验所要求的所有功能和其它一些扩展功能。包括：基本功能——以数字形式显示时、分、秒的时间，小时计数器为同步24进制，可手动校时、校分；扩展功能——仿广播电台正点报时，任意时刻闹钟（选做），自动报整点时数（选做）；其它扩展功能——显示年月日（能处理
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- 四）练习该实验的目的和思路： 程序开始变得复杂起来，可能是大家以前编过的程序中最复杂的，但相对于以后的程序来说还是简单的。因此要认真把握这个过渡期的练习。程序规模大概为200行。本实验和以后的实验相关。通过练习，掌握对字符进行灵活处理的方法。 （五）为了能设计好程序，主意以下事情： 1.模块设计：将程序分成合理的多个模块（函数），每个模块做具体的同一事情。 2.写出（画出）设计方案：模块关系简图、流程图、全局变量、函数接口等。 -4) to practice the purp
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- 四）练习该实验的目的和思路： 程序开始变得复杂起来，可能是大家以前编过的程序中最复杂的，但相对于以后的程序来说还是简单的。因此要认真把握这个过渡期的练习。程序规模大概为200行。本实验和以后的实验相关。通过练习，掌握对字符进行灵活处理的方法。 （五）为了能设计好程序，主意以下事情： 1.模块设计：将程序分成合理的多个模块（函数），每个模块做具体的同一事情。 2.写出（画出）设计方案：模块关系简图、流程图、全局变量、函数接口等。 -4) to practice the purp
P65-3-4
- 四）练习该实验的目的和思路： 程序开始变得复杂起来，可能是大家以前编过的程序中最复杂的，但相对于以后的程序来说还是简单的。因此要认真把握这个过渡期的练习。程序规模大概为200行。本实验和以后的实验相关。通过练习，掌握对字符进行灵活处理的方法。 （五）为了能设计好程序，主意以下事情： 1.模块设计：将程序分成合理的多个模块（函数），每个模块做具体的同一事情。 2.写出（画出）设计方案：模块关系简图、流程图、全局变量、函数接口等。 -4) to practice the purp
P66-3-11
- 四）练习该实验的目的和思路： 程序开始变得复杂起来，可能是大家以前编过的程序中最复杂的，但相对于以后的程序来说还是简单的。因此要认真把握这个过渡期的练习。程序规模大概为200行。本实验和以后的实验相关。通过练习，掌握对字符进行灵活处理的方法。 （五）为了能设计好程序，主意以下事情： 1.模块设计：将程序分成合理的多个模块（函数），每个模块做具体的同一事情。 2.写出（画出）设计方案：模块关系简图、流程图、全局变量、函数接口等。 -4) to practice the purp
Dijkstra_TA
- 数据结构的经典实验程序。以全国主要城市为图的顶点, 铁路连接为图的边, 距离作为加权, 设计完成一个最短路径自动查找系统；输入为出发城市和目标城市, 输出为最短路径和距离。 -data structure of the classic experimental procedure. In major cities across the country to the vertex, the railway linking the edge of the map, as the weighted
dian_zi_xiao_mi_feng
- 本设计采用实验专用小车，以AT89S52单片机为控制核心，加以超声波测距仪、探测电路、通信部分、液晶显示、电源电路以及其他电路构成。系统由89S52通过IO口控制小车的前进后退以及转向。超声波测距仪用来测量小车在封闭的场地里的具体坐标。探测电路用来探测硬币，经通信系统将第一辆小车测得的硬币位置传给第二辆小车,后一辆小车将根据收到的数据自动找到该硬币。同时本系统将测得各项数据通过液晶显示出来。-the experimental design using special trolley to AT
smxsqddl
- 本实验只为了解教学系统中8位八段数码管显示模块的工作原理，设计标准扫描驱动电路模块.-this experiment only to understand the teaching system eight eight LED Display Module principle, design standards scanning drive circuit module.
LRyufafenxi
- LR分析程序设计 实验报告 构造LR 分析程序，利用它进行语法分析，判断给出的符号串是否为该文法识别的句子； （2）了解LR分析方法是严格的从左向右扫描，和自底向上的语法分析方法。 -LR experimental design analysis program LR report tectonic analysis procedure, and use it for syntax analysis, judgment is whether the string of symbol
C51TCPIP-SoC-exam39
- 《SoC单片机实验、实践与应用设计》书中的实验39，即RTL8019A+8051实现TCP/IP的源代码。-"SoC Microcontroller experiment, practice and application design" book of 39. RTL8019A 8051 that the TCP / IP source code.