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  1. 两路十字路口的交通灯控制的VHDL源码

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  2. 两路十字路口的交通灯控制的VHDL源码,毕业设计,,Two-way traffic lights at the crossroads of the VHDL source code control, graduation design,
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-22
    • 文件大小:75.71kb
    • 提供者:wang
  1. 06

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  2. 单片机示波器毕业论文 真的很不错,大家快下啊-Single-chip oscilloscope thesis is true is true that under the U.S. quickly ah
  3. 所属分类:SCM

    • 发布日期:2017-05-16
    • 文件大小:4.16mb
    • 提供者:liuhong
  1. VHDLjiaotongdeng

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  2. 有关毕业设计交通灯的VHDL设计,包括源码程序和仿真图形相关报告。-Traffic lights on the graduation project of VHDL design, including source code and simulation procedures related to the report graphics.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.49mb
    • 提供者:乐乐
  1. 15883852DJDPLV_LWB

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  2. 数字频率计毕业论文 不是自己做的-Digital Cymometer thesis do not own. . Ha ha
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:30.26kb
    • 提供者:崔晓进
  1. IIR

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  2. 毕业设计:基于FPGA的IIR滤波器设计-The design for IIR digital filter based on FPGA
  3. 所属分类:Other systems

    • 发布日期:2017-04-24
    • 文件大小:460.57kb
    • 提供者:lzndcb
  1. FPGA_code

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  2. 基于FPGA设计实例,适合电子类大四学生入门与提高,可以用做课程设计和毕业设计-based FPGA, VHDL code example
  3. 所属分类:source in ebook

    • 发布日期:2017-05-03
    • 文件大小:1.22mb
    • 提供者:zhaoqian
  1. 73462697msk_matlab

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  2. 于毕业设计与论文以及做课题用-MSK Simulink simulation program for the design and graduation thesis topic, and making use -Design and graduation thesis, as well as issues to do with-MSK Simulink simulation program -于毕业设计与论文以及做课题用-MSK Simulink simulation program for
  3. 所属分类:matlab

    • 发布日期:2017-04-04
    • 文件大小:2.06kb
    • 提供者:yujiao
  1. 89346497fpga-example2

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  2. 于毕业设计与论文以及做课题用-MSK Simulink simulation program for the design and graduation thesis topic, and making use -Design and graduation thesis, as well as issues to do with-MSK Simulink simulation program -于毕业设计与论文以及做课题用-MSK Simulink simulation program for
  3. 所属分类:matlab

    • 发布日期:2017-04-08
    • 文件大小:604.42kb
    • 提供者:yujiao
  1. LEDpingsheji

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  2. LED显示屏控制系统及驱动程序的研究与设计(优秀硕士毕业论文)-LED display driver control systems and research and design (excellent Master Thesis)
  3. 所属分类:SCM

    • 发布日期:2017-05-09
    • 文件大小:1.63mb
    • 提供者:wang
  1. VHDl

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  2. 多功能数字时钟的设计,很有用的毕业设计哦-very useful vhdl colock design
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:33.3kb
    • 提供者:葛煜
  1. yuyintongxin

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  2. 基于CPLD的语音通信系统设计与实现毕业设计 原版包括程序源码,各部分仿真图,框图-CPLD-based voice communications system design and implementation of the design of the original graduate program, including source code, the part of simulation diagram, block diagram
  3. 所属分类:Voice Compress

    • 发布日期:2017-05-15
    • 文件大小:3.8mb
    • 提供者:李卫东
  1. FPGApinlvji

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  2. 当年本科时的毕业设计,信号发生器和频率计-The time of the year undergraduate graduate design, signal generator and frequency counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:10.14kb
    • 提供者:zhanglei
  1. lunwenVHDL

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  2. 毕业设计vhdl论文的先期工作。对于大学毕业设计论文有重要作用-Graduate design vhdl advance work papers. For the university graduation thesis plays an important role
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.11mb
    • 提供者:陈涛
  1. DESsuanfa

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  2. DES的加解密算法的实现,无错,非常适合毕业设计运用-DES encryption and decryption algorithm, error-free
  3. 所属分类:Crypt_Decrypt algrithms

    • 发布日期:2017-04-03
    • 文件大小:12.53kb
    • 提供者:longli
  1. VHDL1

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  2. 基于VHDL的电梯控制器的设计,对于毕业设计有很大帮助-VHDL-based elevator controller design, the design of great help for graduation
  3. 所属分类:Other systems

    • 发布日期:2017-05-19
    • 文件大小:5.02mb
    • 提供者:liujun
  1. line_ccd

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  2. 高速线阵CCD图像数据采集系统的研究,是一篇毕业论文,详细介绍了线阵CCD图像采集系统。-High Speed Linear CCD Image Data Acquisition System, is a thesis, detailing the linear array CCD image acquisition system.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6.76mb
    • 提供者:王萍
  1. shejishengjiangji

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  2. 对电梯的基本功能进行了实现,并把电梯的一些特殊功能进行了改进,这是本人的毕业设计程序。-The basic functions of the elevator to achieve, and to lift some of the special features have been improved, this is my graduation project process.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.85kb
    • 提供者:zhengjibin
  1. FFT_report

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  2. 印度一所大学的硕士研究生毕业设计:FFT处理器的的fpga实现-India, a masters graduate of the University of Design: FFT processor for fpga implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:354.32kb
    • 提供者:dawei
  1. CRC

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  2. 基于VHDL的CRC编解码器设计,非常好用的哈。我的毕业设计内容-The CRC VHDL-based codec design, very easy to use, ha. The contents of my graduation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:96.09kb
    • 提供者:kaicer
  1. VHDL-electronic-clock-design

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  2. 毕业论文--基于硬件描述语言VHDL的电子钟设计-Thesis- VHDL hardware descr iption language based on the electronic clock design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.54mb
    • 提供者:独行侠
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