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数字锁相环设计源程序
- PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), 数字锁相技术在通信领域应用非常广泛，本例用VHDL描述了一个锁相环作为参考，源码已经调试过。编译器synplicty.Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF-digital phase-locked loop PLL design source, in which Fi is the input freque
数字锁相环dll_code
- 通信系统中，信号捕获和同步的数字锁相环的MATLAB仿真程序-communications systems, signal acquisition and synchronization of digital PLL MATLAB simulation program
二阶锁相环设计中环路参数的选择
- 用于载波恢复的锁相环参数设计 很有用的哦,希望下载看看,对你有帮助的-for carrier recovery PLL parameters useful in the design Oh, look at the download, you have to help
锁相环计算
- 这是我编写的计算锁相环分频数的一个工具-This is my calculation prepared by the sub - PLL frequency of a tool
数字锁相环
- PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF-digital phase-locked loop PLL design source, in which Fi is the input frequency (receive data), Fo (Q5) is the local output frequency.
锁相环的MATLAB的仿真程序
- 锁相环的详细仿真程序
verilog dpll（数字锁相环）
- 用xilinx ise 10.1实现了数字锁相环，仅供参考
verilog全数字锁相环pll
- verilog全数字锁相环，用VERILOG语言实现的数字锁相环P-VERILOG language with the digital phase-locked loop PLL
adf4360锁相环程序
- adf4360的锁相环程序，基于单片机8051.内有说明，比较有借鉴意义。
锁相环
- MATLAB锁相环仿真，源程序
全数字锁相环
- 详细介绍数字锁相环的工程
锁相环MB1504的c语言驱动程序
- 锁相环MB1504的c语言驱动程序 51单片机控制 完整版,MB1504 PLL driver of c language SCM 51 full version
锁相环
- 经典锁相环，MATLAB simulink编写，点开即可运行，对于学习锁相环的同学很有帮助(Classic phase-locked loop, written in MATLAB Simulink, point to run, for students learning phase-locked loop helpful)
锁相环 Folder
- 可实现labview虚拟锁相，不必通过硬件来实现(for labview lock-in loop)
任务四 Gardner位同步算法与锁相环联合仿真
- Gardner位同步算法与锁相环的联合仿真程序.加入了时偏和频偏，能很好地锁定时偏和频偏，得到最佳采样输出。(Gardner bit synchronization algorithm and phase-locked loop joint simulation program, adding time offset and frequency offset, can well lock the bias and frequency offset, get the best sampling o
并网逆变器的程序电流环控制并有DA以及锁相部分
- 光伏逆变锁相环，使用DSP28335，实现频率跟踪，首先采样，然后PI，然后输出(Photovoltaic inverter PLL, using DSP28335, to achieve frequency tracking, first sampling, then PI, and then output)
锁相放大
- 锁相放大器是一种对交变信号进行相敏检波的放大器(The lock-in amplifier is a phase sensitive detection amplifier for alternating signal)
锁相环
- 实现电压快速锁相跟踪，尤其是电压不平衡时的电压跟踪(Realizing fast phase locked tracking of voltage)
并网逆变器中全软件锁相环的设计与实现
- 讲述并网逆变器中全软件锁相环的设计与实现，，即检测基波正序分量的电网电压不平衡和扭曲的条件下。明确地,提出了一种积极的基于一种新的序列检测器双同步坐标系的解耦锁相环（双dq–PLL），完全消除了检测误差传统的同步参考框架（SRF–锁相环PLL）(and implementation of all software phase-locked loop in grid connected inverter is described, that is, detecting the positive a
PLL（锁相环）_TEST_OK
- 通过STM32程序的编写来形成闭环锁相环，锁住波形的稳定，保持系统的稳定。(Through the preparation of STM32 program to form a closed-loop phase-locked loop, lock waveform stability, maintain the stability of the system)