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  1. 用VHDL语言在CPLD上实现串行通信

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  2. 用VHDL语言在CPLD上实现串行通信-using VHDL on the CPLD Serial Communication
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.04kb
    • 提供者:陈旭
  1. 异步串行口

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  2. 一种基于VHDL语言的实现计算机串行通信的简洁设计
  3. 所属分类:VHDL编程

    • 发布日期:2009-03-16
    • 文件大小:136.69kb
    • 提供者:ouping@yahoo.cn
  1. VHDL-SPI-Module.doc

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  2. 本spi参数化通讯模块是一个支持SPI串行通信协议从协议的SPI从接口。可通过改变参数设置传输的位数,由外部控制器给定脉冲控制传输。-The parameters of spi communication module is a support SPI serial communication protocol from the agreement from the SPI interface. By changing the parameter settings can be transmit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:37.56kb
    • 提供者:
  1. 8b10b_pdf

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  2. 8b10b编解码设计的pdf文章,用于现代千兆网通信,快速串行通信.-.pdf paper
  3. 所属分类:Com Port

    • 发布日期:2017-04-09
    • 文件大小:1.63mb
    • 提供者:hanhaili
  1. iul

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  2. 8.1 可编程并行接口芯片8255A 8.2 可编程定时器/计数器芯片8253/8254 8.3 串行通信及可编程串行接口芯片8251A 8.4 模/数(A/D)与数模(D/A)转换技术 及其接口 -8.1 programmable parallel interface chip 8255A8.2 programmable timer/counter chip 8253/82548.3 serial communications and programmable seri
  3. 所属分类:SCM

    • 发布日期:2017-05-30
    • 文件大小:12.64mb
    • 提供者:麦克
  1. top

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  2. RS232串行通信,采用VHDL编程,由波特率发生器,接收器和发送器构成-RS232 serial communication using VHDL programming, by the baud rate generator, receiver and transmitter constitute
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.44kb
    • 提供者:幸运
  1. uart

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  2. 基于FPGA的uart源代码,异步串行通信,vhdl书写的。-uart codes。write with vhdl.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:274.31kb
    • 提供者:
  1. serialcomvhdl

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  2. 一个串行通信的例子,用vhdl实现。包括发送接收,分频等多个模块-Example of a serial communication with the realization of vhdl. Including the transmission of the reception, a number of modules, such as Frequency Division
  3. 所属分类:Com Port

    • 发布日期:2017-04-06
    • 文件大小:16.93kb
    • 提供者:杨怿菲
  1. web

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  2. 模拟网络串行通信 近期对计算机间通信比较感兴趣,同时研究usb通信原理,起步为串行通信于是想为更好地理解其机理做一定基础性研究,故做了异步串行通信设计实验。 经过QUARTUS验证,获得了一等奖!-Simulation of the recent serial communication network between the communication of more interested in computers, communications usb at the same time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.77mb
    • 提供者:ayls
  1. FPGA

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  2. FPGA和单片机串行通信接口的实现,VHDL的源代码。-And single-chip FPGA realization of serial communication interface, VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:8.52kb
    • 提供者:chengjun
  1. DM7_COLR_LCD_C5T

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  2. 任意信号波形采样和频谱分析演示文件 ADC信号采样、RS232串行通信和频谱分析 增加ADC采样控制模块,接上ADC,即可把模拟信号采入PC机上显示,和相应的频谱分析。 -Arbitrary signal waveforms and spectral analysis of the sampling ADC signal sample presentation, RS232 serial communication and increase the ADC sampling freq
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:41.46kb
    • 提供者:邢旭
  1. VHDLbasicExampleDEVELOPEMENTsoursE

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  2. 这里收录的是《VHDL基础及经典实例开发》一书中12个大型实例的源程序。为方便读者使用,介绍如下: Chapter3:schematic和vhdl文件夹,分别是数字钟设计的原理图文件和VHDL程序; Chapter4:multiplier文件夹,串并乘法器设计程序(提示:先编译程序包); Chapter5:sci文件夹,串行通信接口设计程序; Chapter6:watchdog文件夹,看门狗设计程序; Chapter7:taxi文件夹,出租车计价器设计程序; Chapte
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:135.53kb
    • 提供者:wuyu
  1. Interface

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  2. 已在实验箱上验证,目标芯片EP1C3T144C8 十位全时双工串行通信接口-Interface
  3. 所属分类:Com Port

    • 发布日期:2017-05-14
    • 文件大小:3.27mb
    • 提供者:zhouzhuai
  1. RS232(1)

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  2. 基于FPGA的串行通信接口设计,用硬件描述语言VHDL实现-FPGA-based serial communication interface design, using hardware descr iption language VHDL implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1017.73kb
    • 提供者:吴海霞
  1. uart16

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  2. 一个16位的uart,可以实现串行通信,接受或者发送数据!-A 16-bit uart, serial communication can be achieved, accept or send data!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1020byte
    • 提供者:JOY
  1. VHDL

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  2. 用VHDL语言在CPLD上实现串行通信 应用广泛 远程控制-CPLD with VHDL language to realize the serial communication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:45.46kb
    • 提供者:张硕
  1. I2C

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  2. 语言:verilog 功能:用Verilog HDL编写的I2C主机串行通信的程序。两条总线线路:一条串行数据线 SDA, 一条串行时钟线 SCL;串行的 8 位双向数据传输位速率在标准模式下可达 100kbit/s,快速模式下可达 400kbit/s ,高速模式下可达 3.4Mbit/s;在数据传输过程中,当时钟线为高电平时,数据线必须保持稳定。如果时钟线为高电平时数据线电平发生变化,会被认为是控制信号。 仿真工具:modelsim 综合工具:quartus -Language:
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:7.97kb
    • 提供者:huangjiaju
  1. PIANo

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  2. (1)下载“KX232_PIANO_C5T”文件夹中的sof文件。 (2) 接上串行通信线,与PC机通信。 (3)在“FOR_PC_FILE”文件夹中,双击打开上位机软件“SEND”,按键盘上的“1、2、3.。。”即可弹琴。SEND窗口即显示对应的ASIC码。-(1) Download " KX232_PIANO_C5T" folder in the sof file. (2) connected to the serial communication lines, a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:47.93kb
    • 提供者:袁方
  1. UART2

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  2. 基于SPARTAN-3E的与计算机的异步串行通信,可根据需要更改波特率等等。-SPARTAN-3E based on the asynchronous serial communication with the computer, according to the need to change the baud rate and so on.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:356.57kb
    • 提供者:姚武
  1. 用FPGA实现UART

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  2. 用fpga实现异步串行通信。通过串口助手接收与发送(Implementation of serial communication with FPGA)
  3. 所属分类:串口编程

    • 发布日期:2017-12-21
    • 文件大小:649kb
    • 提供者:大武
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