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当前位置: 首页 资源下载 源码下载 搜索资源 - VHDL 课程设计

搜索资源列表

  1. clock

    0下载:
  2. 电子课程设计数字钟的源代码,已在试验箱上实现,定义了管脚。可以调整时间-E-curriculum design digital clock source code has been achieved in the chamber, the definition of a pin. Can adjust the time
  3. 所属分类:assembly language

    • 发布日期:2017-04-26
    • 文件大小:502392
    • 提供者:龙龙
  1. UART

    0下载:
  2. 简单的uart状态机的编写,作为课程设计的资料,适于入门-UART simple state machine to prepare, as a curriculum design information, suitable for entry-
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:588287
    • 提供者:李欣
  1. chuzuche

    0下载:
  2. 出租车计费系统,我的课程设计。希望大家多多指点-Taxi billing system, I designed the curriculum. I hope everyone a lot of advice! !
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:93088
    • 提供者:陈岩
  1. Octave_organ_EDA_curriculum

    0下载:
  2. 八音电子琴EDA课程设计报告,包含vhdl的程序和原理图文件 -Octave organ EDA curriculum design report, including vhdl schematic diagram of the procedures and documents
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:81249
    • 提供者:香味
  1. VHDL

    0下载:
  2. vhdl教程,很实用的,至少我认为对于我的课程设计有帮助-vhdl tutorial is very useful, at least I think that the curriculum design for my help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5178834
    • 提供者:随云
  1. elevator

    0下载:
  2. 这是一个小课程设计,关于电梯控制的vhdl仿真程序,内容十分完整-This is a small curriculum design, on the elevator control of vhdl simulation program, very complete
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:285481
    • 提供者:fengyun
  1. vhdl

    0下载:
  2. 数字逻辑课程设计,用vhdl实现红外线传输系统的课程设计,下载验证通过-Digital logic course design, using vhdl infrared transmission system to achieve curriculum design, download verified by
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:4097
    • 提供者:李好
  1. h

    0下载:
  2. huffman编码的vhdl语言实现 课程设计做的 有点用的-huffman coding vhdl language curriculum design to achieve a little bit to do with the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:292500
    • 提供者:africanz
  1. STOPWATCH

    0下载:
  2. 是基于FPGA/CPLD的跑表程序,可以存储记录多个运动员的跑步时间,是利用VHDL语言编写的,可以有助于学习EDA技术,可以参考学习,可以帮助你完成VHDL语言的课程设计。-Is based on FPGA/CPLD s stopwatch program, many athletes can store records of running time, is the use of VHDL language, and can help to learn EDA, can refer to t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:661825
    • 提供者:王亮
  1. MATLAB

    5下载:
  2. 基于 MATLAB 的语音信号分析与处理的课程设计.录制一段自己的语音信号,并对录制的信号进行采样;画出采样后语音信号的时域波形和频谱图;给定滤波器的性能指标,采用窗函数法或双线性变换设计滤波器,并画出滤波器的频率响应;然后用自己设计的滤波器对采集的语音信号进行滤波,画出滤波后信号的时域波形和频谱,并对滤波前后的信号进行对比,分析信号的变化;回放语音信号-MATLAB-based voice signal analysis and processing of the curriculum. Re
  3. 所属分类:其他小程序

    • 发布日期:2016-05-29
    • 文件大小:1200981
    • 提供者:姚梅
  1. biaojue

    0下载:
  2. VHDL编写的七人表决器,有做课程设计的有福了-Written in VHDL seven voting machine, there are so blessed Oh curriculum design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:208650
    • 提供者:龙刚
  1. cpu

    0下载:
  2. 16位的CPU的VHDL程序~~还有附加的生成波形,可以应用于课程设计中-16-bit CPU, VHDL ~ ~ There are additional procedures for generating waveforms, can be applied to curriculum design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1053544
    • 提供者:liuying
  1. fir

    0下载:
  2. 真正意思上的fir滤波器课程设计,基于quartus II9.0的vhdl代码。有原理图输入和例化元件-The real meaning of the fir filter design program, based on quartus II9.0 the vhdl code. A schematic of components and cases
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1439867
    • 提供者:liyu
  1. VHDL

    0下载:
  2. EDA技术以EDA软件工具为开发环境,以可编程逻辑器件为实验载体,实现源代码编程和仿真功能。VHDL作为一种标准化的硬件描述语言用于描述数字系统的结构、行为、功能和接口。本设计提出了一种基于VHDL语言的编码器和译码器的实现方法。编码器与译码器是计算机电路中基本的器件,本课程设计采用EDA技术设计编码和译码器。编码器由8线-3线优先编码器作为实例代表,译码器则包含3线-8线译码器和2线-4线译码器两个实例模块组成。课程设计采用硬件描述语言VHDL把电路按模块化方式进行设计,然后进行编程、时序仿
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:797281
    • 提供者:pear
  1. shuziluoji

    0下载:
  2. VHDL课程设计 数字密码锁 设计一个简易的密码锁电路,该锁应在受到3位与规定码相符的十进制数码时打开,使相应指示灯亮;若收到于规定代码不符或者开锁程序有误,表示错误的指示灯亮。-VHDL design course design a digital lock easy lock circuit, the lock should be subject to three decimal consistent with the provisions of the digital code when
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:83248
    • 提供者:sofia
  1. digital-lock

    2下载:
  2. vhdl课程设计电子密码锁的完整可执行程序,最终评为优秀-vhdl program designed electronic locks complete executable program, and ultimately as good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2731893
    • 提供者:苏亮亮
  1. trafficlights

    0下载:
  2. vhdl课程设计的交通灯完整可执行程序,最终评为优秀-vhdl program designed to complete the traffic lights executable program, and ultimately as good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:228045
    • 提供者:苏亮亮
  1. CPUexperiment1G

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  2. vhdl课程设计的CPU程序,实现了CPU的完整功能,最终评为优秀-vhdl program curriculum design of the CPU, the CPU to achieve the full functionality of the final good as
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1400253
    • 提供者:苏亮亮
  1. POCPexperiment

    0下载:
  2. vhdl课程设计的POC程序,功能完整可直接执行,最终评为优秀-vhdl program designed POC program, full-featured to-run, and ultimately as good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:678878
    • 提供者:苏亮亮
  1. VHDL-based-curriculum-design

    0下载:
  2. 基于VHDL实现的电子琴课程设计 VHDL-based curriculum design to achieve the keyboard-VHDL-based curriculum design to achieve the keyboard
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:53069
    • 提供者:wangwenhao
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