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搜索资源列表

  1. bayer2rgb

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  2. bayer到RGB, 12bit进,24bit出,实验效果很理想,简单易用 -bayer to RGB, 12bit entry, 24bit out of the experimental results is very satisfactory, easy to use
  3. 所属分类:VHDL编程

    • 发布日期:2013-10-30
    • 文件大小:12.17kb
    • 提供者:zhangxinggang
  1. DE2_D5M

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  2. 在Quartus ii 10.0的环境下,实现了从D5M摄像头中读取Bayer数据并转化为RGB,通过SDRAM缓存,VGA控制器,输出到显示屏的Verilog代码-In Quartus ii 10.0 Read Bayer format from D5M camera and convert to RGB format, through SDRAM, output on VGA port.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:
    • 文件大小:208.61kb
    • 提供者:Aaron
  1. my_bayer2rgb

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  2. 摄像头Bayer 转rgb信号 用verilog 编写 在xilinx fpga 软件下 ise 综合 编译-Bayer turn the camera rgb signal in xilinx fpga verilog prepared under ise integrated compiler software
  3. 所属分类:VHDL编程

    • 发布日期:2014-02-24
    • 文件大小:9.99mb
    • 提供者:Andy
  1. bayer_sensor_mod

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  2. 基于verilog编写的 CMOS sensor 模型,可以输出bayer 数据,尺寸可调-Verilog prepared by the CMOS sensor model, you can output bayer data, size adjustable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:815byte
    • 提供者:冯代高
  1. bayer

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  2. verilog/ vhdl code for processing the bayer filter signal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:11.7kb
    • 提供者:rahulshandilya1
  1. bilinear_demosaic

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  2. 用硬件描述语言verilog编写的去马赛克程序,将bayer格式转换为RGB格式。(Using Hardware Descr iption Language Verilog prepared by the mosaic process, the Bayer format into RGB format.)
  3. 所属分类:图形图像处理

    • 发布日期:2017-12-20
    • 文件大小:3.4mb
    • 提供者:yifan_zheng
  1. bayer_to_vga

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  2. Bayer 视频流转VGA的Verilog实现,经开发板测试可用(Bayer video streaming VGA Verilog implementation, the development board test available)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-30
    • 文件大小:1kb
    • 提供者:黄小杰
  1. bayer_3RGB_interpolation

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  2. bayer转rgb 源代码,Verilog语言,FPGA上使用,(Bayer to RGB source code, Verilog language, FPGA use,)
  3. 所属分类:VHDL编程

    • 发布日期:2018-03-26
    • 文件大小:10.07kb
    • 提供者:hezhnew
  1. Bayer2RGB

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  2. Bayer 转RGB Verilog代码实现。。5*5 窗口。在工程中应用的(Bayer to RGB Verilog code implementation. 5*5 window. Applied in Engineering)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-03-27
    • 文件大小:14.35mb
    • 提供者:Andy1123
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