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CY7C68013A传输视频数据时的FIRMWARE，使使用SLAVE FIFO模式
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基于CY7C68013A的Slave FIFO和SDRAM控制器
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程式描述：使用Cypress的Cy7C68013A晶片進行設計，實現Slave FIFO模式的資料獲取。程式包括USB韌體程式以及主機程式。
安裝：把來源程式碼複製到硬碟特定目錄下，使用Keil C編譯器和Visual C++ 6.0運行即可。
注意：可以首先使用Cypress的測試工具進行韌體程式的測試，以確保韌體程式的正確性。
-Program Descr iption: Using Cypress
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EZ-USB的CY7C68013A实现Slave FIFO的AutoIN。关键配置见TD_Init函数。-EZ-USB
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usb芯片CY7C68013A例程,接口类型被动先进先出-passive first-in, first-out the usb chip CY7C68013A routine, interface type FIFO
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C++语言编写的针对CY7C68013A芯片的固件程序。包括了对USB Slave FIFO的配置和内部传输管道以及FIFO大小的必要控制。该程序在硬件上通过测试，在没有其他USB设备干扰的应用下，可以确保450Mbps通讯效率。-Firmware control for USB Slave FIFO in CY7C68013A. It define the necessary configuration on transaction segment and pipe as well as FI
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本程序主要用于开发usb数据传输时的CY7C68013A固件程序，采取的是从模式的数据传输，只要把程序直接下载到EZ-USB中，然后再去写设备端程序就可以了。-This procedure is mainly used for the the CY7C68013A firmware development usb data transmission, taken from the mode of data transmission, and, as long as the program is
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使用Cypress的Cy7C68013A芯片进行设计，实现Slave FIFO模式的数据采集。程序包括USB固件程序以及主机程序。,Using Cypress' s Cy7C68013A chip design, data acquisition Slave FIFO mode. The program includes a USB firmware and host program.
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实现CY7C68013 slave FIFO与计算机通信的固件程序-failed to translate
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CY7C68013a的slavefifo的固件源代码，keil编写，以及使用FPGA向EP6端点写数据的verilog源代码，没有错误，可以编译成功!-CY7C68013a of slavefifo firmware source code, keil prepared using FPGA and write data to the endpoint EP6 verilog source code, no errors, you can compile successfully!
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CY7C68013A + XDP512 组成的Slave FIFO 模式，USB2.0传输，传输速度可达3MByte/s。完整的USB芯片代码，完整的主控MCU代码。电路图就不必发了。对于学习68013的Slave FIFO模式是个福音！上位机读写直接用XferData函数就可以了。-CY7C68013A+ XDP512 ，Slave FIFO ，USB2.0，3MByte/s。
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Interface TCD1209DG with Altera FPGA and transfer image data to PC via USB using USB FX2 Slave FIFO mode, Only FPGA code included.
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