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  1. 4_in_1

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  2. 骏龙提供的最新quartus8.0的license,包括Quartus II 8.0,NIOS II 8.0(在Quartus II的license里面),DSP Builde 8.0,ModelSim-Altera 6.1g (Quartus II 8.0),新Quartus II的license支持远程桌面访问的功能。
  3. 所属分类:其它

    • 发布日期:2008-10-13
    • 文件大小:325.74kb
    • 提供者:王网
  1. Altera Modesim破解版的LICENCE

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  2. Altera Modesim破解版的LICENCE. 下载解压后: 1.直接运行mentorkg.exe(生成的license.txt拷贝到D:\altera\80\modelsim_ae\下或者mentorkg.exe拷贝到此目录下运行). 2.设置环境变量lm_license_file="D:\altera\80\modelsim_ae\license.txt" 3.搞定,Altera Modesim cracked version of the LICENCE.
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-24
    • 文件大小:305.81kb
    • 提供者:xingyu
  1. Verilog数字系统设计教程(第2版)

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  2. Verilog数字系统设计教程(第2版)”这本书的思考题没有答案,要多做实验和仿真-• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are programmed o
  3. 所属分类:书籍源码

    • 发布日期:2016-01-27
    • 文件大小:2kb
    • 提供者:shixiaodong
  1. crack-81

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  2. 最新QuartusII8.1的补丁,安装它的破解器,可以获得长期使用权-QuartusII8.1 the latest patch, install it to break, and access to long-term use rights
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:14.38kb
    • 提供者:zxl
  1. source

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  2. ModelSim对Altera设计进行功能仿真的简单操作步骤-modelsim simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:333.48kb
    • 提供者:寻宝人
  1. modlesimcrack

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  2. altera配套modelsim破解程序,绝对好用!注意要改环境变量-altera crack modelsim matching procedure, the absolute ease of use! Attention to environment variables to be changed
  3. 所属分类:Modem program

    • 发布日期:2017-04-02
    • 文件大小:223.07kb
    • 提供者:lj
  1. modelsim-using-guide

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  2. modelsim Altera 5.3的使用教程,适合初学者了解第三方仿真工具。-handbook for modelsim Altera 5.3.It is helpful for learning FPGA.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:493.7kb
    • 提供者:weiwei
  1. Example-b4-1

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  2. Altera基本宏功能的产生和实现方法.定制一个双端口RAM,DualPortRAM,Quartus II仿真器中做门级仿真,在ModelSim中对这个工程进行RTL级仿真.-Altera basic macro functionality of the generation and realization. Customize a dual-port RAM, DualPortRAM, Quartus II simulator to do gate level simulation, on t
  3. 所属分类:VHDL编程

    • 发布日期:2014-03-23
    • 文件大小:296.21kb
    • 提供者:Gorce
  1. Altera_FPGA_develop(QuartusII_7.2_ModelSim_6.5).ra

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  2. Altera FPGA开发说明(QuartusII 7.2 & ModelSim 6.5).pdf 建立和编译QII项目 modelsim功能仿真 QII引脚分配 modelsim时序仿真(建立Altera仿真库) QII下载 -Altera FPGA Development Descr iption (QuartusII 7.2 & ModelSim 6.5). Pdf project to establish and build QII QII pin ass
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.9mb
    • 提供者:
  1. modelsim-ALTERA-manual

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  2. 经常的modelsim使用手册,和Altera公司的FPGA软件配套使用-Regular modelsim manual, and Altera' s FPGA software supporting the use of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.91mb
    • 提供者:hemy
  1. ModelSim-Altera61g_CRACK

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  2. modelsim 6.2破解,对于ALTERA 器件-MODELSIM 6.2 CRAK FOR ALTORAL CHIP
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:301.33kb
    • 提供者:wangfei
  1. Modelsim-functional-simulation

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  2. 介绍了Model Technology 公司的Modelsim XE II v5.6e的主要结构、属性设置、Modelsim XE II v5.6e与ISE5.2的软件接口,测试激励文件的建立以及Modelsim仿真分析方法。Altera公司QuartusII3.0仿真器(Simulator) 的主要结构、属性设置以及仿真分析方法。 -Introduced the Model Technology Modelsim XE II v5.6e company' s main struct
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:732.22kb
    • 提供者:zfj
  1. Chapter-2

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  2. Verilog数字系统设计教程(第2版)”这本书的思考题没有答案,要多做实验和仿真-• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.91kb
    • 提供者:shixiaodong
  1. Chapter-3

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  2. Verilog数字系统设计教程(第2版)”这本书的思考题没有答案,要多做实验和仿真-• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:4.29kb
    • 提供者:shixiaodong
  1. Chapter-4

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  2. Verilog数字系统设计教程(第2版)”这本书的思考题没有答案,要多做实验和仿真-• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:7.23kb
    • 提供者:shixiaodong
  1. Chapter-5

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  2. Verilog数字系统设计教程(第2版)”这本书的思考题没有答案,要多做实验和仿真-• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:14.83kb
    • 提供者:shixiaodong
  1. Chapter-6

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  2. 练习六在verilog hdl中使用函数317 -• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are programmed on
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:2.91kb
    • 提供者:shixiaodong
  1. Chapter-7

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  2. 练习七在verilog hdl中使用任务(task)319 -• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:7.35kb
    • 提供者:shixiaodong
  1. ModelSim-Settings

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  2. 设置ModelSim仿真步骤,运用Quartus II 13.0 (32-bit) University Program VWF 波形文件编程功能后,使用ModelSim-Altera进行仿真。-Set ModelSim simulation steps, using Quartus II 13.0 (32-bit) University Program VWF programming function waveform file, use the ModelSim-Altera simulat
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:377.32kb
    • 提供者:yuantielei
  1. 添加库2

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  2. 在modelsim中实现硬件库的调用,实现类似SRAM的仿真(Implement the call of the hardware Library in Modelsim and implement the simulation like SRAM)
  3. 所属分类:硬件设计

    • 发布日期:2018-01-09
    • 文件大小:2.17mb
    • 提供者:雾部17
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