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  1. multiplyingunit

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  2. 其乘法器原理是:乘法通过逐项移位相加原理来实现,从被乘数的最低位开始,若为1,则乘数左移后与上一次的和相加;若为0,左移后以全零相加,直至被乘数的最高位-Its multiplier principle is: the sum of multiplication through each shift principle to achieve, from the lowest bit multiplicand to start, if 1, then the multiplier on the l
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:133.94kb
    • 提供者:张华
  1. Serialadder

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  2. VHDL语言串行加法器 可以实现五位加法运算-Serial adder five addition operations can be achieved
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:721byte
    • 提供者:赵珑
  1. SA_VHDL-

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  2. a simple serial adder in vhdl, enjoy it
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:594byte
    • 提供者:afshin
  1. da2c

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  2. VHDL硬件描述语言实现DA转化-In quurtus call half adder to achieve 16-bit serial adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.51kb
    • 提供者:lemony
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