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搜索资源列表

  1. wjnce-CAMERA

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  2. 基于wince的底层驱动,用于生成dll的原始代码,本程序主要针对于sangsumg6410外围设备(camera)的驱动有严格的时序分析-Based on the underlying drivers wince, the original code used to generate the dll, the program aimed at sangsumg6410 peripherals (camera) driver has strict timing analysis
  3. 所属分类:Windows CE

    • 发布日期:2017-04-05
    • 文件大小:416.41kb
    • 提供者:meng
  1. TimingDesigner

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  2. 非常简单易用的画时序图工具,用于时序设计、流程分析很实用-Very easy to use timing diagram drawing tool for timing design, flow analysis is very useful
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2016-01-25
    • 文件大小:3.5mb
    • 提供者:jakeywym
  1. CRC

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  2. 这个是我花了一个星期的CRC算法,有并行与串行的区别与时序的分析。。。。希望站长能够同意-This is a week I spent the CRC algorithm, there is the difference between parallel and serial and timing analysis. . . . Hope that regulators can not agree
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-04-02
    • 文件大小:734.54kb
    • 提供者:heshuiming
  1. CTune0.9

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  2. 主要用于时序分析,无论是ASIC还是FPGA以及DSP都很有效的.欢迎大家使用-Mainly used for timing analysis, whether it is ASIC or FPGA and DSP are very effective. Welcome to use
  3. 所属分类:DSP program

    • 发布日期:2017-03-30
    • 文件大小:107.87kb
    • 提供者:大赛分
  1. 9411003

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  2. technology mapping and static timing analysis
  3. 所属分类:Static control

    • 发布日期:2017-04-03
    • 文件大小:106.98kb
    • 提供者:yichuchen
  1. StaticTimingAnalysis

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  2. FPGA硬件设计的时序分析详细教程,包括保持、建立时间概念、毛刺等分析-FPGA hardware design tutorials detailed timing analysis, including the establishment of the concept of time, such as analysis of burr
  3. 所属分类:Static control

    • 发布日期:2017-05-02
    • 文件大小:658.63kb
    • 提供者:JET
  1. jiajianfazhiling

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  2. (1)课程设计的题目。(2)设计的目的及设计原理。 (3)根据设计要求给出模型机的逻辑框图。 (4)设计指令系统,并分析指令格式。 (5)设计微程序及其实现的方法(包括微指令格式的设计,后续微地址的产生方法以及微程序入口地址的形成)。 (6)模型机当中时序的设计安排。(7)设计指令执行流程。 (8)给出编制的源程序,写出程序的指令代码及微程序。 (9)说明在使用软件HKCPT的联机方式与脱机方式的实现过程(包括编制程序中每指条令的时序分析,累加器A和有关寄存器、存储器的数
  3. 所属分类:Education soft system

    • 发布日期:2017-03-30
    • 文件大小:786.11kb
    • 提供者:朱良
  1. ProgrammingEmbeddedSystemKeil8051

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  2. This book will help for those who want to start embedded programming. given good real time examples with timing analysis.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-05-10
    • 文件大小:2.1mb
    • 提供者:koneru
  1. wlli

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  2. good material about Static Timing Analysis primetime and Formal verificationformality
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-04
    • 文件大小:323.39kb
    • 提供者:rfanddsp
  1. PCI_VHDL

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  2. 从PCI时序分析入手,重点阐述了PCI通用的状态机设计,说明了用VHDL语言来实现本PIC通信状态机的软件设计以及进行MaxPlusII验证的程序和方法。用该方法所设计的接口既可支持PCI常规传输,又可支持PCI猝发传输。-PCI timing analysis from the start, focusing on general-purpose PCI state machine design, described by VHDL language to achieve the PIC c
  3. 所属分类:Other systems

    • 发布日期:2017-03-05
    • 文件大小:178.38kb
    • 提供者:lilei
  1. 1569201756

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  2. A research paper on "Timing Analysis of Passive UHF RFID - EPC C1G2 System in Dynamic Frame"-A research paper on "Timing Analysis of Passive UHF RFID- EPC C1G2 System in Dynamic Frame"
  3. 所属分类:RFID

    • 发布日期:2017-04-09
    • 文件大小:270.36kb
    • 提供者:chandan
  1. StaticTimingAnalysis

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  2. 静态时序分析(Static Timing Analysis简称STA)经由完整的分析方式判断IC是否能够在使用者的时序环境下正常工作,对确保IC质量之课题,提供一个不错的解决方案。然而,对于许多IC设计者而言,STA是个既熟悉却又陌生的名词。本文将力求以简单叙述及图例说明的方式,对STA的基础概念及其在IC设计流程中的应用做详尽的介绍。-Static timing analysis (Static Timing Analysis referred to as STA) through a com
  3. 所属分类:Static control

    • 发布日期:2017-03-29
    • 文件大小:709.04kb
    • 提供者:王铭义
  1. static_time_analysis

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  2. Static Timing Analysis is a method of computing the expected timing of a digital circuit without requiring simulation.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-04
    • 文件大小:7.35kb
    • 提供者:ankit
  1. modelsim-timing-analysis

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  2. 自己整理的一个关于如何使用modelsim进行功能仿真,时序仿真和布局布线的后仿真的文档,例子是抄的,针对的版本是modelsim se6.2b-Their finishing a feature on how to use modelsim for simulation, timing simulation and post-layout simulation of the document, copy the example is for the version of modelsim se
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:689.37kb
    • 提供者:雍振强
  1. analysis

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  2. 很经典的华为时序分析资料,用于电路的时序分析-Huawei is the classic time series analysis data for circuit timing analysis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:682.95kb
    • 提供者:hemiao
  1. Maxplus-timing-simulation

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  2. 主要介绍Max_plus_的时序仿真与时序分析,对刚入门的很有帮助意义。-Introduced Max_plus_ timing simulation and timing analysis, meaning just getting started helpful.
  3. 所属分类:Windows Develop

    • 发布日期:2017-05-04
    • 文件大小:1.17mb
    • 提供者:Aaran
  1. Timing-analysis

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  2. FPGA玩转Altera之时序篇,包括时序分析注意事项-Altera play the FPGA XuPian, including timing analysis the matters needing attention
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.97mb
    • 提供者:蔡历鑫
  1. Timing-Analysis

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  2. 关于VHDL/VERILOG进行EDA设计时序分析时需要注意的一些需要注意的问题及处理策略,保证相当实用,请需要的人参考-VHDL/VERILOG the EDA design timing analysis need to pay attention to some issues that need attention and treatment strategies, guaranteed to be quite practical, please need Reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:10.13mb
    • 提供者:张炽
  1. Timing

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  2. 国外关于时序设计的一本非常好的书,写得非常详细,包括时序的分析的原理-Abroad on timing design of a very good book, written in great detail, including the principle of timing analysis, etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5.28mb
    • 提供者:linhanxiong
  1. IO-timing-constrain-in-fpga

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  2. 对FPGA的IO口的时序分析小结,能够详细理解其约束时序规则-FPGA timing analysis summary of IO port, capable of a detailed understanding of its timing constraint rules
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:184.94kb
    • 提供者:张龙
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