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搜索资源列表

  1. sheji2

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  2. 一个秒表的硬件设计,学习数字电路中基本RS触发器、单稳态触发器、时钟发生器及计数、译码显示等单元电路的综合应用。-The hardware design of a stopwatch, learn basic digital circuit in the RS flip-flops, monostable multivibrator, the clock generator and counting, decoding display unit integrated circuit applic
  3. 所属分类:Other systems

    • 发布日期:2017-04-16
    • 文件大小:127.69kb
    • 提供者:周妮
  1. clock

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  2. 基于VHDL的函数信号发生器,可输出方波,阶梯波,三角波,正铉波,用示波器观察-VHDL-based function of the signal generator can output a square wave, step-wave, triangle wave, positive-hyun waves observed with an oscilloscope
  3. 所属分类:Other systems

    • 发布日期:2017-05-13
    • 文件大小:3.05mb
    • 提供者:niha
  1. vhdl_code_files

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  2. contains some self generated vhdl files. it includes a clock generator, CRc generator, pulse generator etc.
  3. 所属分类:Other systems

    • 发布日期:2017-04-02
    • 文件大小:10.31kb
    • 提供者:pri
  1. cpu

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  2. 包括1) 时钟发生器 2) 指令寄存器 3) 累加器 4) RISC CPU算术逻辑运算单元 5) 数据控制器 6) 状态控制器 7) 程序计数器 8) 地址多路器 -1) clock generator 2) instruction register 3) accumulator 4) RISC CPU arithmetic logical unit 5) of the data controller 6) state controller 7),
  3. 所属分类:Other systems

    • 发布日期:2017-03-28
    • 文件大小:430.13kb
    • 提供者:liuying
  1. pmuxxplusii-vr

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  2. 用VHDL开发的数字时时钟,可变宽度脉冲产生器 -VHDL development of digital clock, variable-width pulse generator
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-16
    • 文件大小:8.84kb
    • 提供者:条款
  1. test_clkgen

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  2. Test Clock Generator. You can learn how to implement test clock generator in VHDL
  3. 所属分类:Other systems

    • 发布日期:2017-04-12
    • 文件大小:815byte
    • 提供者:salih
  1. kebenchengxu

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  2. VHDL代码,一些课本的小程序。包含3线-8线译码器,4选1选择器,6层电梯,8线-3线编码器,8线-3线优先编码器,8选1,BCD-7段显示译码器真值表,半加器,摩尔状态机,数字频率计,数字时钟,同步计数器,序列检测器的设计,序列信号发生器,一般状态机等等。(The small program of some textbooks. Includes 3 -8 decoder, 4 1 selector, 6 elevator, line 8 Line 8 line -3 encoder, -3
  3. 所属分类:其他

    • 发布日期:2018-04-22
    • 文件大小:40kb
    • 提供者:girl_lily
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