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文通过ALTERA公司的quartus II软件，用Verilog HDL语言完成多功能数字钟的设计。主要完成的功能为：计时功能，24小时制计时显示；通过七段数码管动态显示时间；校时设置功能，可分别设置时、分、秒；跑表的启动、停止 、保持显示和清除。-Through the ALTERA company quartus II software, using Verilog HDL language to complete the design of multi-function digital
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用vhdl语言描述时钟的功能，并通过七段译码输出。-VHDL language used to describe the function of the clock and through the Seven-Segment decoder output.
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用vhdl语言描述时钟的功能，并通过七段译码显示输出。-VHDL language used to describe the function of the clock and through the Seven-Segment display decoder output.
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用vhdl语言控制七段显示管和八个LED灯的程序，并通过下载验证。-VHDL language used to control Seven-Segment display tube and eight LED lights procedures and verification by downloading.
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七段LED数码显示器是数字系统中常用的数码显示元件，二进制数不能直接在LED数码管上显示，需要用一个BCD七段译码器进行译码。下图给出了一个七段显示译码器的框图及相应的七段LED数码管的示意图。-Seven-segment LED digital display is commonly used in digital systems digital display devices, a binary number can not be directly displayed on the LED
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该程序用VHDL语言实现了LED七段显示的功能-The program implemented using VHDL language features LED seven-segment display
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简单的七段数码管译码器vhdl程序,比较基础,适合初学者练习使用-Simple seven-segment decoder vhdl program basis for comparison, for beginners to use.
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VHDL语言实现10位学号在七段数码管上的显示，并且学号由左右两侧分别一一向中间逐个显示，能够实现多组不同的学号实现-VHDL language to achieve 10 number in the seven segment digital tube display, and the number of left and right sides respectively by one one to the middle one display, can realize the differe
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Nexys 3 seven segment display module written in VHDL
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七段译码器的verilog实现。VHDL，单片机开发程序，数字逻辑与处理器基础实验，你懂d。-Seven segment decoder verilog implementation. VHDL, MCU development program, the digital logic and processor basic experiment, you know d.
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基于vhdl语言编写的简易计算器程序，其中主要功能有加减乘和清除，确定等，可实习现连续运算。输出使用七段数码管输出，输入采用拨码开关的方式输入。若计算结果超过99999，蜂鸣器自动报警。-Vhdl language based on simple calculator program, where the main function, subtraction, multiplication and clear, determined, can now practice continuous op
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SEVEN SEGMENT DISPLAY, ON VHDL, ISE DESIGN SUITE 14.7, XILINX
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