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  1. jiafaqi

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  2. 实现四位加法器的VHDL代码，里面含有全加器的代码-achieve four Adder VHDL code, which contains the full adder code

  3. 所属分类：其它

    • 发布日期：2008-10-13
    • 文件大小：828byte
    • 提供者：丘志光

  1. Afixed-pointbasecomplementdivider

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  2. 由寄存器,全加器,移位寄存器,计数器,触发器和门电路构成补码一位除法器,将开关设定的补码形式出现的除数,被除数存入相应寄存器中.能用单脉冲按步演示运算全过程.

  3. 所属分类：其它

    • 发布日期：2014-01-16
    • 文件大小：140.44kb
    • 提供者：JOE

  1. h_adder

    0下载：
  2. 本文件包是在MAX+plus II 软件环境下实现全加器的逻辑功能

  3. 所属分类：其它

    • 发布日期：2014-01-16
    • 文件大小：12.88kb
    • 提供者：罗理平

  1. Example-3-1

    0下载：
  2. 该程序是用quartus II作为开发工具，用verilog语言编写，实现全加器功能的实例。对初学者很有意义

  3. 所属分类：其它

    • 发布日期：2008-10-13
    • 文件大小：887byte
    • 提供者：xyq
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