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搜索资源列表

  1. uart2iic

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  2. UART转I2C的Verilog HDL代码,由北京邮电大学《VerilogHDL设计与EDA技术基础》教师编写
  3. 所属分类:串口编程

    • 发布日期:2014-01-17
    • 文件大小:2.52kb
    • 提供者:emulous
  1. demo_24c01a

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  2. 24C01A的Verilog HDL仿真代码,用于I2C接口模块的测试,由北京邮电大学《VerilogHDL设计与EDA技术基础》教师编写
  3. 所属分类:串口编程

    • 发布日期:2014-01-17
    • 文件大小:1.13kb
    • 提供者:emulous
  1. VerilogHDL

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  2. verilog举例,参考价值较大,可以学习参考用-verilog example, a larger reference value
  3. 所属分类:Communication-Mobile

    • 发布日期:2017-04-24
    • 文件大小:170.82kb
    • 提供者:张洪
  1. verilogHDL

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  2. RS(31,15)译码关键步骤的veilog HDL算法实现,包括关键方程求解,错误位置估计,错误值计算等-RS (31,15) decoding a key step in the algorithm veilog HDL, including key equations, position estimation error, error value, such as
  3. 所属分类:3G develop

    • 发布日期:2017-03-31
    • 文件大小:12.04kb
    • 提供者:冯小刚
  1. RS232_Interface

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  2. verilogHDL串口逻辑,波特率为96-verilogHDL serial interface logic
  3. 所属分类:Com Port

    • 发布日期:2017-03-30
    • 文件大小:280.53kb
    • 提供者:文奇
  1. RX_SYN

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  2. OFDM接收机新型同步算法的实现,采用verilogHDL语言,经测试性能良好-OFDM receiver to achieve the new synchronization algorithm, using verilogHDL language, good performance tested
  3. 所属分类:3G develop

    • 发布日期:2017-04-24
    • 文件大小:137.95kb
    • 提供者:tony
  1. RX_RS_DEC

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  2. OFDM系统新型RS编解码的verilogHDL设计,经测试误码率性能提高-OFDM system verilogHDL new RS codec design, improved bit error rate performance tested
  3. 所属分类:3G develop

    • 发布日期:2016-03-16
    • 文件大小:9kb
    • 提供者:tony
  1. RS_CC_ENC

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  2. OFDM系统新型CC编解码的verilogHDL设计,与RS编码级联,经测试误码率性能提高-OFDM system verilogHDL new CC codec design, coding and RS cascade, tested BER performance improvement
  3. 所属分类:3G develop

    • 发布日期:2017-04-14
    • 文件大小:3.58kb
    • 提供者:tony
  1. CRC5_CRC16_USB

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  2. USB2.0数据包CRC 16,TOKEN令牌包是CRC5,VerilogHDL代码 多项式y=1+x^2+x^15+x^16; y=1+x^2+x^5; 只是串行1位的代码, 并行8位,16位没有上传(USB CRC 16 , VerilogHDL code polynomial(0_2_15_16); polynomial(0_2_5))
  3. 所属分类:USB编程

    • 发布日期:2017-12-13
    • 文件大小:6.04kb
    • 提供者:诡迹xjn
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