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搜索资源列表

  1. DDS+PLL

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  2. 基于FPGA的新的DDS+PLL时钟发生器-FPGA-based new DDS PLL clock generator

  3. 所属分类：通讯/手机编程

    • 发布日期：2008-10-13
    • 文件大小：142.19kb
    • 提供者：李敏

  1. CLOCK

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  2. 本程序实现了FPGA应用中的时钟程序的相关功能，很重要-implemente the fpga clock on relative function

  3. 所属分类：3G develop

    • 发布日期：2017-04-03
    • 文件大小：898byte
    • 提供者：我佛慈悲

  1. uart

    0下载：
  2. 实现UART的FPGA代码，包括发送模块、接受模块、时钟模块。-UART in fpga,include translate module,receive module an clock module.

  3. 所属分类：Com Port

    • 发布日期：2017-04-14
    • 文件大小：2.93kb
    • 提供者：黎静宏
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