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搜索资源列表

  1. DDC_DUC

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  2. 数字上下变频FPGA设计的详细介绍资料,还是中文的。很舍不得上传的哦。-FPGA digital down conversion design detailed information, or Chinese. Oh, very reluctant to upload.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:349.47kb
    • 提供者:陈洁
  1. fangz

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  2. 数字通信系统的仿真,包括调制解调,上下变频,加入了高斯白噪声,并且每个步骤都生成相应的图形-Digital communication system simulation, including the modulation and demodulation, the upper and lower frequency, by adding Gaussian white noise, and each step generates the appropriate graphics
  3. 所属分类:DSP program

    • 发布日期:2017-02-08
    • 文件大小:33.77kb
    • 提供者:maominchao
  1. ImplementationofHighSpeedUpDownConversionFIRFilter

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  2. 为了对FPGA 的资源占用量最小,以便实现 片上系统(SoC)设计,充分利用了上下变频过程中I,Q 数据流的特点,仅用一套滤波器运算单元分时复用对I,Q 滤波,同时详细研究了滤波器的转置结构和位平面结构对FPGA资源占用量的差别。-Benefiting from the characteristics of I and Q data streams in the converter。 one set of computation units is multiplexed to fil
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:168.09kb
    • 提供者:cslbetter
  1. OFDM-_matlab

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  2. OFDM里常用到的模型,一个相对完整的OFDM通信系统的仿真设计,包括编码,调制,IFFT,上下变频,高斯信道建模,FFT,PAPR抑制,各种同步,解调和解码等模块,并统括系统性能的仿真验证了系统设计的可靠性。 -OFDM where commonly used to model a relatively complete OFDM communication system simulation design, including coding, modulation, IFFT, and
  3. 所属分类:DSP program

    • 发布日期:2017-04-01
    • 文件大小:22.73kb
    • 提供者:fengfeng
  1. fpgaUPDW

    0下载:
  2. fpga上下变频混频实现,其中CIC采用多种方法设计,自己花两个星期编写,中文注释,浅显易懂-fpga up and down conversion mixer implemented which CIC using a variety of methods designed, he spent two weeks writing notes in Chinese, easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:2.07kb
    • 提供者:胡昊波
  1. 3-ddc-cic_5hb_firmatlab-testbench)

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  2. 三通道上下变频cic_5hb_firmatlab仿真程序-Three-channel down conversion cic hb fir matlab simulation program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:9.54kb
    • 提供者:wq
  1. BPSK

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  2. 先用Matlab理论仿真,得出滤波器系数。再用Verilog语言在ISE环境下编写程序,通过Modelsim和ChipScope进行波形仿真和引号抓取,从而提高调试的效率。通过手机发送指令来控制上下变频器的参数。(Firstly, the filter coefficients are obtained by simulation with the theory of matlab. Then the program is written in Verilog language under IS
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-02-25
    • 文件大小:6.43mb
    • 提供者:财哥在此
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