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  1. rad10

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  2. 利用basys2实现十进制加减可逆计数器,拨码开关键SW1为自动可逆加减功能键,当SW1为HIGH时,计数器实现自动可逆模十加减计数功能,即4个七段数码管上几乎同步显示0—1—2—3—4—…9—8—7—…0—1…的模十自动可逆加减计数结果;当SW1为LOW时,计数器按拨码开关键SW0的选择分别执行加减计数功能。即当SW0为HIGH时,计数器实现模十加计数功能,即4个七段数码管上几乎同步显示0—1—2—3—4—…9——0—1…的模十加计数结果;当SW0为LOW时,计数器实现模十减计数功能,即4个七
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:194443
    • 提供者:小雨
  1. MCS51

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  2. 二进制定点数运算/二进制浮点数运算/十进制(BCD码)数运算/代码转换/数据变换/排序、查找和非线性算法/数学函数/树和图/ 延时与跳转控制/人机交互接口/单片机测控接口/51单片机内部资源编程实例/单片机数据传输接口/波形发生与控制实例/C51单片机软件抗干扰和数字滤波-Binary fixed-point number operations/binary floating-point operations/decimal (BCD) operation/sorting/code conver
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-27
    • 文件大小:130155
    • 提供者:潘涛
  1. S2_counter_NEW

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  2. 设计一个以十进制为基础的计数器,实现从 0 开始的计数功能;本实验主要是利用开发板上面的数码管实现一个十进制计数器的功能,计数范围0000-9999,可实现循环计数。先输入verilog 程序,然后在 QuartusII 中做波形仿真,通过后下载程序在数码管上查看计数器的功能。-Designing a decimal-based counters, a zero-counting function this experiment is the use of digital control b
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:111952
    • 提供者:赵厉
  1. s15_lab13_1a

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  2. 并行8位A/D(电压测量)实验,将ADC0809采集到的数字量以十进制格式显示在右边三维数码管上-Eight parallel A/D (voltage measurement) experiment, the ADC0809 digital collection to be displayed on the right side of the three-dimensional digital tube in decimal format
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-15
    • 文件大小:6901
    • 提供者:林琳
  1. TLC1620

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  2. 基于FPGA的Verilog语言实现的六十进制计数器-FPGA-based Verilog language implementation of six decimal counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:226281
    • 提供者:
  1. TEN

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  2. 异步的十进制计数器程序源代码,实现十进制计数-TEN CONTER
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:244229
    • 提供者:afu
  1. jisuanqi

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  2. STM8计算器基于设计,可以实现任何八个十进制数的四则运算,并且可以连续的处理多个数据之间的运算关系-STM8 calculator-based design can achieve any eight decimal four operations, continuous processing operation relations between the multiple number
  3. 所属分类:SCM

    • 发布日期:2017-04-13
    • 文件大小:2126
    • 提供者:于东东
  1. EXP2_IOkou-xuexi

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  2. 绘制实验仿真原理图,编写运行程序,实现将十进制数156拆为三个BCD码,并存入30H开始的三个单元,采用汇编语言和C51语言完成。-The simulation draw schematics, write to run the program, to achieve the decimal number 156 split into three BCD, and stores 30H three units started. Subjects were using assembly langu
  3. 所属分类:SCM

    • 发布日期:2017-04-28
    • 文件大小:40505
    • 提供者:李亮
  1. digital-frequency-meter

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  2. 1.用VHDL完成12位十进制数字频率计的设计及仿真。 2.频率测量范围:1Hz∼ 10KHz,分成两个频段,即1∼ 999Hz,1KHz∼ 10KHz,用三位数码管显示测量频率,用LED显示表示单位,如亮绿灯表示Hz,亮红灯表示KHz。 3.具有自动校验和测量两种功能,即能用标准时钟校验、测量精度。 4.具有超量程报警功能,在超出目前量程档的测量范围时,发出灯光和音响信号。 -1. VHDL design and simulation comple
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:45466
    • 提供者:项小娇
  1. 51-c

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  2. 该程序把精度计算到了小数点后第七位,并且根据各个位数的不同发送相应的单位。 在二进制和十进制单位的转换过程中,进行了一定的人为的修正-The program of the accuracy of the calculation to the seventh decimal places, and the corresponding unit depending on the transmitting each digit. During the conversion process bina
  3. 所属分类:SCM

    • 发布日期:2017-04-15
    • 文件大小:6126
    • 提供者:王一舒
  1. LCD_IR

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  2. 将红外解码的按键的十进制键值显示在TFT上,TFT驱动IC为ILI9325。-Show IR Key Number On TFT。TFT Driver is ILI9325。
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-29
    • 文件大小:328687
    • 提供者:
  1. 407decode

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  2. 密钥加密解密demo,对8位十进制密码操作,包含异或以及随机移位操作代码部分,基于STM32f407_RTC,可移植-Key encryption and decryption demo, to 8 decimal cryptographic operations, comprising XOR and random shift operation code section, based STM32f407_RTC, portable
  3. 所属分类:SCM

    • 发布日期:2017-05-25
    • 文件大小:8536461
    • 提供者:cheng
  1. Digital-Password-Lock

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  2. 数字密码锁具体要求如下: 1. 系统密码设置使用拨位开关sw[7:0],限定为4位密码;sw[7:6]、sw[5:4]、sw[3:2]、sw[1:0]分别对应从左到右密码的第1、2、3、4位;每一位的取值范围限定在0、1、2三个数中。 2. 用btn[2:0]作为输入键,btn[0]、btn[1]、btn[2]分别对应的有效输入为十进制数0、1、2(由于btn数有限,系统不支持解锁含有数字3的密码)。 3. 输入的密码显示在7段数码显示管对应位上,顺序为从左至右,未输入密码时数码管
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:4725
    • 提供者:刘东辉
  1. counter10

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  2. 十进制计数器,比较简单,比较容易,希望大家不要见怪-decimal counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:668
    • 提供者:hp
  1. eda

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  2. 一百进制计数器,以十进制计数器为模板增加十位计数,可类比写出多位计数器。九十九清零。-One hundred binary counter, decimal counter increased ten count as a template, you can write a number of analog counter. Ninety-nine cleared.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:558114
    • 提供者:陈睿祺
  1. AnJian_1602

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  2. 计算器设计。采用了现场可编程逻辑器件FPGA设计,并基于VHDL语言实现加减乘除功能,并用十进制显示在数码管上。计算部分为加法器、减法器、乘法器和除法器组成。使用Altera公司的QuartusII开发软件进行功能仿真并给出仿真波形,并下载到试验箱,用实验箱上的按键开关模拟输入,用数码管显示十进制计算结果。通过外部按键可以完成四位二进制数的加、减、乘、除四种运算功能,其结果简单,易于实现。-Calculator design. Using a field programmable logic d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-31
    • 文件大小:13138994
    • 提供者:陈勒
  1. cnt100

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  2. 一百进制计数器,采用层次化设计,底层文件为十进制计数器,顶层文件原理图设计-the procedure is based on vhdl,it can count 100,and use top-down
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:682005
    • 提供者:niuniu
  1. count_num_1

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  2. 将十进制数转化为二进制,并计算二进制中1的个数-Converts a decimal number to binary, and calculate the number of binary 1
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-30
    • 文件大小:324891
    • 提供者:Xuefei
  1. DINGSHI

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  2. 使用定时器的定时中断,根据硬件电路编程实现一个计数器,使之从0开始以1秒的速度以十进制加1计数,并在数码管上显示出来。-Timed using a timer interrupt, to implement a counter based on hardware circuit programmed to start at a speed 0 to 1 second plus 1 count in decimal, and displayed on the digital tube
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:834
    • 提供者:kk543
  1. 3111

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  2. 任意十进制转换为2进制,4进制,8进制,16进制-Arbitrary binary decimal conversion of 2, 4 hex, 8 decimal, 16 hex
  3. 所属分类:SCM

    • 发布日期:2017-04-12
    • 文件大小:800
    • 提供者:jing743881
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