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搜索资源列表

  1. 译码器

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  2. 通过对用硬件描述语言VHDL表示的某个专用部件(如中断控制器、差错控制码编码/译码器,此为译码器)的代码分析,构建它的逻辑结构,加深对相关部件设计技术的理解。 试验平台:MaxPlusII -through the use of VHDL hardware descr iption language said a special components (such as interrupt controllers, error control coding / decoding devic
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:29.45kb
    • 提供者:johnmad
  1. mcutongxin

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  2. 单片机用485协议进行远程通信的主机程序和从机程序。在差错方面用了“校验和”的办法排除通信干扰,实践证明效果非常。方便大家参考。-SCM agreements with 485 long-distance communications from the host machine procedures and procedures. Error in connection with the "checksum" exclude communications interferen
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:2.31kb
    • 提供者:马亮
  1. CRCCalculateWayRealizes

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  2. 在远距离数据传输中进行差错控制一种重要的方法CRC算法。程序是用C语言实现。内有详细解释,可读性和移植性强。-in remote data transmission error control for an important method of CRC algorithm. Procedure is used C language. Are explained in detail, readability and portability strong.
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:2.53kb
    • 提供者:陈才炜
  1. datalink-selective 数据链路层—选择性重传协议

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  2. 数据链路层的选择性重传协议的编写。在仿真环境下编程实现有噪音信道环境下 两站点之间无差错双工通信。信道模型为8000bps 全双工卫星信道,信道传播时延270毫秒,信道误码率 为10-5,信道提供字节流传输服务,网络层分组长度固定为256字节-The data link layer selective retransmission protocol preparation. In the simulation environment, programming environment,
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2012-11-15
    • 文件大小:203.25kb
    • 提供者:chenchen
  1. ucos2_2440

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  2. ucosii 移植到ARM 9 2440环境 基本已经完成 没有最终试验 恐有差错 -ucosii ported to ARM 9 2440 environment has basically been completed there is no final test may have errors
  3. 所属分类:uCOS

    • 发布日期:2017-03-28
    • 文件大小:197.8kb
    • 提供者:jasonasdf
  1. CRC

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  2. 关于通信系统中循环差错检测的vhdl仿真程序,内容十分完整-Communication systems on the circle of error detection of vhdl simulation program, very complete
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:219.94kb
    • 提供者:fengyun
  1. calculator

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  2. 以单片机为系统的处理核心,来完成对外部数据的采集,并按照用户指令要求对数据进行简单的运算,生成结果并输出。在此过程中,会通过系统的键盘和显示部分来进行人机的交互,方便操作者对处理过程的掌握,以及系统对处理中差错的警报。-The simple calculator design uses the MCS-51 as the data processing center.The system can calculate intger plus/minus.And the process can be
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-31
    • 文件大小:1.89kb
    • 提供者:张俊杰
  1. embedlinux

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  2. 嵌入式系统具备下列特性: 1. 通常只执行特定功能,这一点与一般桌上型办公设备或数据库系统有很大区别。 2. 以微电脑与周边器件构成核心,其规模可在大范围内变化,如从8051芯片到x86芯片。 3. 要求严格的时序和稳定性,这是因为在机器控制的大型系统中,程序运行稍有差错则可能使得整个系统失去控制,甚至酿成灾害。 4. 全自动操作循环-Embedded systems have the following features: 1. Usually perform a speci
  3. 所属分类:Embeded Linux

    • 发布日期:2017-05-31
    • 文件大小:13mb
    • 提供者:门票
  1. Wireless_video_communications_technologies_classic

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  2. 无线视频通信差错控制技术经典资料Wireless video communications technologies classic error control information-Wireless video communications technologies classic error control information Wireless video communications technologies classic error control information
  3. 所属分类:SCM

    • 发布日期:2017-05-18
    • 文件大小:4.62mb
    • 提供者:航将
  1. crc

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  2. CRC校验原理 1、循环校验码(CRC码):是数据通信领域中最常用的一种差错校验码,其特征是信息字段和校验字段的长度可以任意选定。 2、生成CRC码的基本原理:任意一个由二进制位串组成的代码都可以和一个系数仅为‘0’和‘1’取值的多项式一一对应。例如:-Principle 1 CRC checksum, cyclic checksum (CRC code): is the data communications of the most commonly used error checki
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:60.61kb
    • 提供者:mengchao
  1. ViterbiFPGA

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  2. 探讨了CDMA 数字移动通信中的差错控制问题, 研究用约束度K = 9 的卷积编码 和最大似然V iterbi 译码的差错控制方案. 在V iterbi 译码算法中, 提出了原位运算度量、保 存路径转移过程和循环存取幸存路径等方法, 能有效地减少存储量、降低功耗, 使得K = 9 的V iterbi 译码算法可在以单片XC4010 FPGA 为主的器件上实现, 其性能指标符合CD2 MA 数字移动通信IS 95 标准要求. 文中给出了实测的算法性能, 讨论了FPGA 具体实现
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:358.25kb
    • 提供者:tsincons
  1. dianzichen

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  2. 这个是单片机电子称的程序.对AT24C02进行多次写操作时,中间必须相隔5ms 2.乘法运算时,乘数必须和积的数据类型相统一。 注意:不同的数据类型进行运算时,极易出现隐蔽性的差错。 要么定义为相同的数据类型,要么使用强制转换。 另外,涉及到乘法运算时,存在着运算过程中,某个被乘数 的变量的内容被“非法”修改的现象。 如果碰上这种情况,重新赋值就可以了。 通过单步调试来发现这个隐形杀手。-. On AT24C02 write several time
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:121.04kb
    • 提供者:小蔡
  1. crc_16

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  2. 16位的CRC(循环冗余校验码),CRC是数据通信领域中最常用的一种差错校验码,其特征是信息字段和校验字段的长度可以任意选定。-16-bit CRC (cyclic redundancy check code), CRC is the data communications of the most commonly used error checking code, which is characterized by the information field and check the len
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:649byte
    • 提供者:陈华
  1. UHF-RFID-CRC

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  2. 本文首先研究了IsO/IECl8000.6标准中A、B两类短程通讯的前向链路与返回 链路的数据编码方式,对(FMO)双相间隔编码、(PIE)脉冲间隔编码、曼切斯特码 的编解码方式和技术参数进行了深入的分析,并利用FPGA实验平台对这三种编 码的编、解码电路进行了设计和仿真。然后对UHF RFID系统的差错控制技术原理 进行了探讨,重点研究了ISo/IECl8000.6标准中采用的数据保护与校验技术,即 循环冗余校验(CRC)技术。分析了基于线性反馈移位寄存器(LFSR)实现C
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:4.16mb
    • 提供者:HY jian
  1. 33162769crcm

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  2. 基于FPGA的差错控制编码,CRC循环校验码的VHDL程序代码,含仿真文件-FPGA-based error control coding, CRC cyclic check code VHDL code, including simulation file
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1023byte
    • 提供者:Angela Lee
  1. FPGA-convolutions-encoder

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  2. 卷积码是数字通信中很重要的一种差错控制编码 具有很好的性能,用硬件的形式描述具有速度快,便于修改的优点,通过该种方法设,计的编码器经测试运行可靠正确。-Convolutional codes are very important in digital communication error control coding with a good performance, with the descr iption of the hardware in the form of a fast, eas
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3.75kb
    • 提供者:will li
  1. HDLC1

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  2. 高级数据链路控制规程HDLC,数据链路层是OSI参考模型的第二层,它在物理层提供的通信接口与电路连接服务的基础上,将易出错的数据电路构筑成相对无差错的数据链路,以确保DTE与DTE之间、DTE与网络之间有效、可靠地传送数据信息。-High-Level Data Link Control protocols HDLC, Data link layer is a second layer of the OSI reference model, which provides the physical
  3. 所属分类:SCM

    • 发布日期:2017-04-07
    • 文件大小:102.2kb
    • 提供者:lijiang
  1. encoder_test

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  2. 光电编码程序,带角度记忆功能,掉电保存,可靠性高,从未出过差错!-Optical encoder program, with angle memory function, power-down save, high reliability, never made a mistake!
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-11-20
    • 文件大小:7kb
    • 提供者:mrzhou
  1. juanjima

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  2. 卷积码是深度空间通信系统和无线通信系统中常用的一种差错控制编码。它克服了分组码由于以码块为单位编译码而使分组间的相关信息丢失的缺点。(2,1,8)卷积码在2G、3G通信系统-The convolutional code is used in deep space communication system and a wireless communication system an error control coding. It overcomes the block code and the
  3. 所属分类:SCM

    • 发布日期:2017-12-08
    • 文件大小:6.21kb
    • 提供者:邓纬
  1. Berlekampalgorithm_Verilog_hdl

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  2. RS编码器是Reed Solomon编码器的简称,它是目前最有效、应用最广泛的差错控制编码方法之一。-The RS encoder Reed Solomon encoder referred, it is the most effective, the most widely used error control coding method one.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:25.82kb
    • 提供者:chenkun
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