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  1. lt

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  2. 用汇编语言写的数字钟程序,结合数码管,能够显示分和秒-a digital clock, showing seconds and minutes
  3. 所属分类:SCM

    • 发布日期:2017-04-08
    • 文件大小:1231
    • 提供者:luoyong
  1. ds1302clock

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  2. 简易数字钟,运用DS1302程序。可实现时间调整,年月日时分秒。-Simple digital clock, using DS1302 process. Allows time to adjust, minute and second years Day.
  3. 所属分类:SCM

    • 发布日期:2017-04-25
    • 文件大小:67066
    • 提供者:胡豆豆
  1. Written_in_VHDL_Digital_Clock_Design

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  2. VHDL语言编写的数字钟设计Digital Clock Design,电子系很经典的实验设计-Written in VHDL, Digital Clock Design Digital Clock Design, Department of Electronic Engineering is the classic experimental design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:153292
    • 提供者:小玲
  1. Principles_of_EDA_to-achieve_multi_function_Digita

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  2. EDA多功能数字钟原理实现Principles of EDA to achieve multi-function Digital Clock-Principles of EDA to achieve multi-functional digital clock Principles of EDA to achieve multi-function Digital Clock
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:153293
    • 提供者:小美
  1. en_ctrl(u)

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  2. 此源码为基于FPGA的液晶屏显示的数字钟程序,程序包含强大的液晶显示控制模块。-The source code for the FPGA-based LCD screen display digital clock program, the program includes a powerful liquid crystal display control module.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:165674
    • 提供者:王强
  1. 806shuzizhongbiao

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  2. 用51单片机和DS12887做一个有年月日时分秒及闹钟功能的数字钟-make a real time clok with c52 SCM and DS12CR887A
  3. 所属分类:SCM

    • 发布日期:2017-04-08
    • 文件大小:2153
    • 提供者:kong
  1. shuzizhong

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  2. 基于VHDL的数字钟的设计,本文给出了详细的代码,直接可用!-VHDL-based digital clock design, this paper presents a detailed code, directly available!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:1347
    • 提供者:马聪聪
  1. clock

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  2. 数字钟,用VHDL 编写。具有计时,校时(调分调时),报时功能-Digital clock, written with VHDL. With time, school time (when the tone on tones), timekeeping function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:192542
    • 提供者:xiaoyu
  1. final

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  2. 基于VHDL的数字钟实现,适用于大学数字电路与逻辑设计课程的期末考试或实验内容-VHDL-based digital clock implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:284702
    • 提供者:王梦舟
  1. PicClockDemo

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  2. 采用VC++开发平台,创建显示数字钟的静态文本框。- Uses VC++ to develop the platform, the foundation demonstrates the digital clock s static text frame.
  3. 所属分类:SCM

    • 发布日期:2017-04-02
    • 文件大小:39348
    • 提供者:awei
  1. 0710200134

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  2. 本文介绍了一个多功能电子钟的设计方案。该方案具有计时、整点报时、校时、校分、闹钟等多项功能。此方案基于Altera 公司的 Cyclone 芯片及Quartus II 7.2 软件。整体设计采用自顶向下的设计思想,大量使用了器件模块化操作。本文对于研究数字钟及扩大其应用,有着非常现实的意义。-This paper describes a multi-clock design. The program has the time, the whole point of time, school ho
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:774443
    • 提供者:王稠黯
  1. shuzizhong

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  2. 写的是一个数字钟的程序,能正常显示时,分,秒。并能同过键盘调节。-Describes a digital clock program that can properly display hours, minutes, seconds. And can be adjusted with the keyboard too.
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:64385
    • 提供者:古玉
  1. shuzizhong_VHDL

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  2. 用VHDL语言写了数字钟程序,并用数码管显示,经过硬件调试可行-timer clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:640457
    • 提供者:cc
  1. shuzhizhong

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  2. 基于单片机数字钟,用8个数码管,三个按键实现时间的现实和改动-Microcontroller based digital clock, with 8 digital tube, the three keys to achieve the reality of time and changes
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:1595
    • 提供者:yannantian
  1. clock

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  2. 带闹铃的单片机数字钟-MCU digital clock with alarm
  3. 所属分类:SCM

    • 发布日期:2017-04-13
    • 文件大小:2090
    • 提供者:game
  1. shuzizhong

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  2. 多功能数字钟,可调时间,可报时,可控制,可以按键显示-duo gongneng shuzizhong
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:164533
    • 提供者:fanker
  1. EDA

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  2. EDA设计报告,实现多功能数字钟功能,在此基础上加上闹钟,秒表-EDA
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:403225
    • 提供者:高超
  1. 1602

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  2. 本程序是利用51单片机控制1602液晶构成的数字钟程序-This procedure is to use 51 MCU 1602 LCD digital clock program consisting of
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:11895
    • 提供者:zhangchengwen
  1. baweishumaguan

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  2. 8位数码管汇编数字钟,适合单片机初学者了解数码管。-8-bit digital tube digital clock assembly, suitable for beginners to understand the digital single chip.
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:2562
    • 提供者:龙锋
  1. EDA4

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  2. 数字钟设计:实现动态数码管显示时分秒; 可以预置为12小时计时显示和24小时计时显示;一个调节键,用于调节目标数位数字。对调节的内容敏感,如调节分钟或秒时,保持按下时自动计数,否则以脉冲计数。 -Digital clock design: dynamic digital display, hour can be preset to 12-hour time display and 24-hour time display a regulatory key target for reg
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:208649
    • 提供者:周旋
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