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asddf
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BasedontheTMS320C64xhigh-definitionvideodecoderopt
- 论文设计了基于高性能通用DSP TMS320C64x的HDTV视频解码程序。该解码 程序针对C64的特殊架构做了多方面的优化。特别是对变长解码、IDCT和运动 补偿三个关键模块人工编写了汇编语言程序、调整了流水线操作。经过优化，显 著提高了解码效率。通过软件仿真可以得出如下重要结论：1）进行人工汇编优 化之后的程序效率相比于仅仅采用C语言优化之后的程序效率提高了将近七倍； 2）人工汇编优化之后，对标准清晰度视频进行实时解码时要求的时钟频率仅为 228.8MHz；3）对高清
VxWorks_timer
- VxWorks系统下时钟及定时器的应用.pdf Vxworks经典论文 VxWorks嵌入式系统中的时钟及定时器的应用
ARMEmbeddedSystemSoftwareDesignofRealTimeClock
- ARM嵌入式系统软件实时时钟的设计,是转自微机信息的一篇论文.-ARM Embedded System Software Design of Real-Time Clock
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- 用51单片机设计的时钟电路（毕业论文）用51单片机设计的时钟电路（毕业论文）-Designed with 51 single-chip clock circuit (Thesis)
Use51ClockElectricCircuitsOfMachineDesign
- 用51单片机设计的时钟电路(毕业论文) 用51单片机设计的时钟电路(毕业论文)-Use 51 clock electric circuits of machine design( graduation thesis)
51clockcircuitThesis
- 用51单片机设计的时钟电路（毕业论文）资料-Single-chip design with 51 clock circuit (Thesis) data
dpj
- 用51单片机设计的时钟电路（毕业论文）很不错的设计.值得参考-Single-chip design with 51 clock circuit (Thesis) The design is pretty good. It is also useful
lunwen
- 潘明海 刘英哲 于维双 (论文) 中文摘要： 本文讨论了一种可在FPGA上实现的FFT结构。该结构采用基于流水线结构和快速并行乘法器的蝶形处理器。乘法器采用改进的Booth算法，简化了部分积符号扩展，使用Wallace树结构和4-2压缩器对部分积归约。以8点复点FFT为实例设计相应的控制电路。使用VHDL语言完成设计，并综合到FPGA中。从综合的结果看该结构可在XC4025E-2上以52MHz的时钟高速运行。在此基础上易于扩展为大点数FFT运算结构。 -Pan Mingha
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- 基于单片机的电子时钟系统设计论文，包含电路图和源码-Electronic clock system based on single chip design of papers, including schematics and source code
Microcontrollerdigitalelectronicclock
- 本文介绍了一款基于AT89S51单片机数字钟的设计，通过多功能数字钟的设计思路，详细叙述了系统硬件、软件的具体实现过程。论文重点阐述了数字钟硬件中MCU模块、语音模块、时钟模块和相关控制模块等的模块化设计与制作；软件同样采用模块化的设计，包括中断模块、闹钟模块、语音模块、时间调整模块设计，并采用简单流通性强的C语言编写实现。本设计实现了时间与闹钟的修改功能、语音播报功能、年、月、日和星期的显示功能。并且通过对比实际的时钟，查找出了误差的来源，确定了调整误差的方法，尽可能的减少误差，使得系统可以达
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- VHDL电子时钟设计论文，利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。-VHDL design of e-paper clock, using a complete inter-chip clock source, buttons, speakers and monitors (digital control) than all the digital circuit functions.
at89c51
- 单片机at89c51电子时钟论文，内附源代码以及模拟电路图-SCM at89c51 electronic clock papers, containing the source code and the analog circuit
High-Speed-FFT
- 优秀硕士论文，课题采用现场可编程门阵列((FPGA)，设计实现了一种超高速FFT处理器。目前，使用FPGA实现FFT多采用基2和基4结构，随着FPGA规模的不断扩大，使采用更高基数实现FFT变换成为可能。本课题就是采用Alter的Stratix II芯片完成了基16-FFT处理器的设计。在设计实现过程中，以基2-FFT搭建基16-FFT的运算核，合理安排时序，解决了碟形运算、数据传输和存储操作协调一致的问题。由于采用流水线工作方式，使整个系统的数据交换和处理速度得以很大提高。本设计实现了4096
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- 全数字OQPSK解调算法的研究及FPGA实现 论文介绍了OQPSK全数字接收解调原理和基于 软件无线电设计思想的全数字接收机的基本结构，详细阐述了当今OQPSK数字 解调中载波频率同步、载波相位同步、时钟同步和数据帧同步的一些常用算法， 并选择了相应算法构建了三种系统级的实现方案。通过MATLAB对解调方案的 仿真和性能分析，确定了FPGA中的系统实现方案。在此基础上，本文采用Verilog HDL硬件描述语言在Altera公司的QuartusⅡ开发平台上设计
1664dianzhenshizhong
- 基于单片机的16*64点阵时钟显示屏的论文，C程序代码，原理图，PCB板，实物图-Based on single chip clock display 16* 64 dot matrix paper, C code, schematics, PCB, physical map
0037、基于单片机的数字钟设计论文资料
- 本设计以单片机AT89S52为切入点，通过使用AT89S52的内部的可编程定时器/计数器，结合对外接晶振的调节来确定一个合适的振荡周期，从而确定出内部的机器周期。再通过对内部中断程序的设置来设计出时钟程序，即设计出了电子时钟的核心。然后在核心电路的基础上设计出了相应的扩展电路，使本设计更加实用。(The AT89S52 single-chip design as the starting point, through the use of AT89S52 internal programmabl