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搜索资源列表

  1. GFEMultiplierTaps

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  2. 用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:8.88kb
    • 提供者:ChenQiu
  1. GFEConsMulTaps

    0下载:
  2. 用于生成GF(2^m)有限域中常数乘法器的Verilog HDL源文件的C程序
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:7.87kb
    • 提供者:ChenQiu
  1. GFEInvertor

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  2. 用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:8.9kb
    • 提供者:ChenQiu
  1. xor_mul

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  2. 使用列表法,VHDL语言实现的基于多项式基的有限域乘法器,用于AES算法等对有限域乘法有要求的算法
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:188.88kb
    • 提供者:zxzx
  1. GFverilog-hdl

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  2. 伽罗华域的乘法器的设计,使用有限域设计乘法器-Galois field multiplier design, the use of finite field multiplier design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1.52kb
    • 提供者:许皓天
  1. monopole_antenna_FDTD

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  2. PDF文档,介绍了等离子体覆盖下,单极天线的各项参数,得到等离子频率也发射电压和谐振频率偏移的关系。文章采用的分析方法是时域有限差分法。-PDF document, presented under the coverage of plasma, the parameters of a monopole antenna, the frequency of emission by the plasma voltage and resonant frequency shift of the relat
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-05-14
    • 文件大小:3.41mb
    • 提供者:albert
  1. ff_const_mul

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  2. 常系数有限域乘法器,verilog DHL源码-Constant coefficient finite field multiplier, verilog DHL source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:610byte
    • 提供者:韩卫平
  1. FPGA--AES-algorithm

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  2. 本文介绍了AES 数据加密结构, 以及相关的有限域的知识及简单运算, 提出了一种用FPGA 高速实现AES 算法的方案, 该方 案设计的加密模块支持AES 标准的三种密钥长度: 128,192,256, 支持ECB, CBC, CTR 三种工作模式, 即支持feedback 和non- feedback 两种模式, 最后给出了本设计的性能指标-This article describes the AES data encryption structure, as well as the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:235.09kb
    • 提供者:李仁杰
  1. RS(204-188)decoder

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  2. rs_decoder.v(顶层文件), SyndromeCalc.v(计算伴随式), BM_KES.v(BM求解关键方程), Forney.v(Forney算法求误差样值), CheinSearch.v(搜索错误位置),ff_mul.v(有限域乘法)。 ROM及初始化文件: rom_inv.v(求逆运算), rom_power.v(求幂运算); rom_inv.mif(ROM初始化文件), rom_power.mif(ROM初始化文件)。 仿真波形:
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:15.09kb
    • 提供者:杜洵
  1. RS(204-188)decoder_verilog

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  2. 采用verilog实现的有限域GF(28)弱对偶基乘法器,本原多项式: p(x) = x^8 + x^4 + x^3 + x^2 + 1 ,多项式基: {1, a^1, a^2, a^3, a^4, a^5, a^6, a^7},弱对偶基: {1+a^2, a^1, 1, a^7, a^6, a^5, a^4, a^3+a^7}-Verilog achieved using the finite field GF (28) weak dual basis multiplier
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:13.94kb
    • 提供者:刘建涛
  1. RS(204,188)译码器的设计

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  2. RS(204,188)译码器说明 原文件: rs_decoder.v(顶层文件), SyndromeCalc.v(计算伴随式), BM_KES.v(BM求解关键方程), Forney.v(Forney算法求误差样值), CheinSearch.v(搜索错误位置),ff_mul.v(有限域乘法)。 ROM及初始化文件: rom_inv.v(求逆运算), rom_power.v(求幂运算); rom_inv.mif(ROM初始化文件), rom_po
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-09-18
    • 文件大小:15kb
    • 提供者:HelloFrank0
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