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搜索资源列表

  1. LIBRARYIEE1

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  2. 译码器,将八位输出转换为七段译码显示,相当于7448驱动译码管-Decoder, the 8 output is converted to seven segment decoding shows that the equivalent of 7448
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:4.62kb
    • 提供者:翟术然
  1. 8051Frequecy--rotationalSpeedDetector

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  2. 8051 頻率_ 轉速 偵測器 ( 以 7448 搭配 共陰 + 2N2222 四位數七段顯示器 )-8051 Frequecy _ rotational speed Detector
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-14
    • 文件大小:4.07kb
    • 提供者:Elbert6688
  1. qinjian

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  2. 模为七和模为十的计数器,并用proteus仿真运行成功,芯片有74161,7448,7400等。-Mold and die for seven to ten counter, and with proteus simulation is successful, the chips have 74161,7448,7400, etc.
  3. 所属分类:SCM

    • 发布日期:2017-04-17
    • 文件大小:20.73kb
    • 提供者:尹越
  1. yinyue

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  2. 模为七和模为十的计数器,并用proteus仿真运行成功,芯片有74161,7448,7400,希望对你有一定的帮助。-Mold and die for seven to ten counter, and with proteus simulation is successful, the chips have 74161,7448,7400, I hope you have some help.
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:82.8kb
    • 提供者:尹越
  1. qiduanxianshiyima

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  2. 利用译码程序在FPGA/CPLD中实现16进制数的译码显示.通过EDA原理图设计方法利用prim库中7448芯片进行7段译码显示-Using decode program FPGA/CPLD realized in hexadecimal number decoding display. Through the EDA principle diagram design method using the prim library 7448 chips for 7 period of decodin
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:49.8kb
    • 提供者:韩延罡
  1. add-plus

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  2. 实现计数器加法、减法、清零电路。用7448、74ls192实现,可以仿真成功,适用于初学者。-Realization counter addition, subtraction, clear circuit. By 7448,74 ls192 achieve success can be simulated, for beginners.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-16
    • 文件大小:15.19kb
    • 提供者:风轻扬
  1. hpc2-7448

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  2. 飞思卡尔HPC2-7448开发板Vxworks6.8 BSP包-freescale HPC2-7448 Evaluation Board vxworks 6.8 BSP
  3. 所属分类:VxWorks

    • 发布日期:2017-05-13
    • 文件大小:2.66mb
    • 提供者:ukbat
  1. hpc2-7448

    0下载:
  2. HPC2-7448 BSP PowerPC
  3. 所属分类:VxWorks

    • 发布日期:2017-12-14
    • 文件大小:632.56kb
    • 提供者:Saad
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