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9.1_ONE_PULSE
- 基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器 9.1.1 由系统功能描述时序关系 9.1.2 流程图的设计 9.1.3 系统功能描述 9.1.4 逻辑框图 9.1.5 延时模块的详细描述及仿真 9.1.6 功能模块Verilog-HDL描述的模块化方法 9.1.7 输入检测模块的详细描述及仿真 9.1.8 计数模块的详细描述 9.1.9 可编程单脉冲发生器的系统仿真
9.2_LCD_PULSE
- 基于Verilog-HDL的硬件电路的实现 9.2 具有LCD显示单元的可编程单脉冲发生器 9.2.1 LCD显示单元的工作原理 9.2.2 显示逻辑设计的思路与流程 9.2.3 LCD显示单元的硬件实现 9.2.4 可编程单脉冲数据的BCD码化 9.2.5 task的使用方法 9.2.6 for循环语句的使用方法 9.2.7 二进制数转换BCD码的硬件实现 9.2.8 可编程单脉冲发生器与显示单元的接口
9.3_Pulse_Counter
- 基于Verilog-HDL的硬件电路的实现 9.3 脉冲计数与显示 9.3.1 脉冲计数器的工作原理 9.3.2 计数模块的设计与实现 9.3.3 parameter的使用方法 9.3.4 repeat循环语句的使用方法 9.3.5 系统函数$random的使用方法 9.3.6 脉冲计数器的Verilog-HDL描述 9.3.7 特定脉冲序列的发生 9.3.8 脉冲计数器的硬件实现 -based on V
9.4_PULSE_FRE
- 基于Verilog-HDL的硬件电路的实现 9.4 脉冲频率的测量与显示 9.4.1 脉冲频率的测量原理 9.4.2 频率计的工作原理 9.4.3 频率测量模块的设计与实现 9.4.4 while循环语句的使用方法 9.4.5 门控信号发生模块的设计与实现 9.4.6 频率计的Verilog-HDL描述 9.4.7 频率计的硬件实现 -based on Verilog-HDL hardware Circuit of
9.5_PULSE_WIDTH
- 基于Verilog-HDL的硬件电路的实现 9.5 脉冲周期的测量与显示 9.5.1 脉冲周期的测量原理 9.5.2 周期计的工作原理 9.5.3 周期测量模块的设计与实现 9.5.4 forever循环语句的使用方法 9.5.5 disable禁止语句的使用方法 9.5.6 时标信号发生模块的设计与实现 9.5.7 周期计的Verilog-HDL描述 9.5.8 周期计的硬件实现 9.5.9 周期测
9.6_PULSE_Level
- 基于Verilog-HDL的硬件电路的实现 9.6 脉冲高电平和低电平持续时间的测量与显示 9.6.1 脉冲高电平和低电平持续时间测量的工作原理 9.6.2 高低电平持续时间测量模块的设计与实现 9.6.3 改进型高低电平持续时间测量模块的设计与实现 9.6.4 begin声明语句的使用方法 9.6.5 initial语句和always语句的使用方法 9.6.6 时标信号发生模块的设计与实现 9.6.7 脉冲高低电平持续
9.7_DIRIVER_control
- 基于Verilog-HDL的硬件电路的实现 9.7 步进电机的控制 9.7.1 步进电机驱动的逻辑符号 9.7.2 步进电机驱动的时序图 9.7.3 步进电机驱动的逻辑框图 9.7.4 计数模块的设计与实现 9.7.5 译码模块的设计与实现 9.7.6 步进电机驱动的Verilog-HDL描述 9.7.7 编译指令-\"宏替换`define\"的使用方法 9.7.8 编译指令-\"时间尺度`timescale
PICC9.7.ZIP
- PICC 9.7 MPLABTDE PIC18 PIC12 PIC16 开发环境-PICC 9.7 MPLABTDE PIC18 PIC12 PIC16 development environment
scan_LED
- 1） 输入设备为4*4矩阵键盘，分别代表0~F； 2） 输出设备为四位数码显示管，初始值显示0000，当按下某一键时，最右边的一位数码显示管显示最新一次所按按键的数值，而之前的显示值左移，例如，第一次按‘1’键，则显示0001；第二次按‘3’键，则显示0013；第三次按‘5’键，则显示0135；第四次按‘7’键，则显示1357；第五次按‘9’键，则显示3579，第四次按‘F’键，则显示579F-1) input device for the 4* 4 matrix keyboard,
Embended_Stream_DVR.tar
- 国内某公司嵌入式DVR，视频监控完整项目源代码。实现了dhcp，bootload，等-/************************************************************************/ /* Solution designed by shaobin. Programmed by shaobin. Copyright 2002-2007 The Hikvision, Inc. $ Revers
ccsds
- ccsds 解码器，适用于9\7小波变换无损、有损-ccsds
7-segment-display-0-to-9
- 7段数码管显示0到9的数字，已经通过测试，可以实现仿真-7-segment display 0 to 9, have been tested, simulation can be achieved
for-0-9
- this the 7 segmant display -this is the 7 segmant display
code-qt
- Qt-Embedded编程实战,包括9.1-hello，9.2-button，9.3-signal&slot，9.4-dialog，9.5-layout，9.6-progressbar，9.7-text input，9.8-menu，9.9-qt draw，9.10-i18n，9.12-designer。源自中嵌教程-Qt-Embedded programming combat, including the 9.1-hello ,9.2-button ,9.3-signal & slot
dspbuilder6-9.1crack
- dsp builder 6.0 7.0 8.0 9 .1 破解-dsp builder 6.0 7.0 8.0 9.0 9.1 crack
STC_ISP_v4.7.9
- 学习51单片机好助手,希望好好利用，我找了好久哦，有其他需要联系我-Learn 51 good assistant SCM，you should use it better,it takes me a lot of time to find it,if you have some need,you can connect me
verilog-0.9.7.tar
- iverilog 0.9.7源码文件，Verilog转换工具-iverilog 0.9.7
DE2_SD_Card_Audio(quartus-9.0)
- 本代码为Altera DE2开发板例程源码（EP2C35F672C6)，quartus II 9.0以上版本均可编译（随板光盘为quartus II 7.2版在9.0以上版本上编译会报错）。本工程实现SD的音频播放器，即通过FPGA控制SD卡，读取SD的音频文件，通过WM8731进行播放。-In this demonstration we show how to implement an SD Card Music Player on the DE2 board, in which th
image1
- Demonstrates image compression using biorthogonal 9/7 wavelet filters.
实验9 PWM输出实验
- The timer can be used to generate PWM output. Advanced setting The timer TIM1 and TIM8 can generate up to 7 PWM outputs simultaneously. And universal timers can produce up to 4 at the same time PWM output of the road(In order for