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  1. 65filter

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  2. 65位FIR数字滤波器的设计~~其中有通过仿真得出得数据 ~可以通过数据输入完成滤波实验~对数字滤波器得整个算法进行了分析包括输入分组相加 然后相乘得过程-65 FIR digital filter design ~ ~ with simulation data to come in through the importation of data from experiments completed filtering of the digital filter in the whole alg
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:2.9kb
    • 提供者:凌燕
  1. code

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  2. This project is "digital serial multiplier". this proh=ject is used to multiply the serial data with parallel data. the source code is writtenby using vhdl.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:4.77kb
    • 提供者:RUPA KRISHNA
  1. jisuanqi_and_wannianli

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  2. 计算器是用LCD显示,按键输入数据,能进行简单的加减乘除运算,最大数据位8位,支持小数运算。万年历用的是DS18B20芯片,用LCD显示时分秒,温度及制作人的名字。-Calculator with LCD display, keyboard input data, can be a simple add, subtract, multiply and divide operation, maximum 8 data bits, support decimal arithmetic. Calend
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:126.8kb
    • 提供者:yangcheng
  1. Ex3_3

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  2. TMS320C54x片内有1条程序总线,3条数据总线和4条地址总线。这3条数据总线(CB、DB和EB)将内部各单元连接在一起。其中,CB和DB总线传送从数据存储器读出的操作数,EB总线传送写到存储器中的数据。并行运算就是同时利用D总线和E总线。其中,D总线用来执行加载或算术运算,E总线用来存放先前的结果。 并行指令有并行加载和乘法指令,并行加载和存储指令,并行存储和乘法指令,以及并行存储和加/减法指令4种。所有并行指令都是单字单周期指令。并行运算时存储的是前面的运算结果,存储之后再进行加载或
  3. 所属分类:DSP program

    • 发布日期:2017-04-07
    • 文件大小:3.99kb
    • 提供者:laozhao
  1. multiply

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  2. 单片机多字节乘法,实现32位乘以32位整形数据相乘,然后把64位结果高32位和低32位分别存放。带Protues仿真文件,已验证算法结果-Microcontroller multibyte multiplication, 32 times the 32-bit plastic data multiplication, and the results the 64 high 32 bits and low 32-bit storage respectively. Protues simulati
  3. 所属分类:SCM

    • 发布日期:2017-04-30
    • 文件大小:38.99kb
    • 提供者:金俊
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