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- VERILOG source code of a H.264 baseline decoder.
Cabad
- MPEG-4/AVC - H.264 CABAC decoder written in VHDL and synthesis on a Virtex 5
optimization-of-H.-264
- 本文描述了基于TMS320DM642 DSP 多媒体平台的H. 264 解码器的实现和优化。简单介绍了该解码器的 硬件平台之后,讲述了移植解码器的过程,包括将基于PC 的H. 264 解码程序DSP 化 随后介绍了针对各解码模块的 优化方法。实验结果表明:与原始的H. 264 解码器(JM74) 相比,该解码器提高了运行速度,可以进行实时应用。-This paper describes the implementation and optimization of H. 264 decod
nova_latest
- h.264完整的解码器，用verilog实现，属于opencores-h.264 full decoder, implemented by verilog, one of opencores
bluespec-h264_latest.tar
- H.264硬件视频解码，采用verilog代码设计，支持1.5M时钟下30bps的QCIF分辨率的实时视频解码-H. 264 hardware video decoder, use verilog code design, support under 1.5 M clock 30 BPS QCIF resolution of real-time video decoding