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搜索资源列表

  1. quartusII

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  2. 华为内部教程(比较早的) 对Quartus 流程中各阶段进行较为详细 的介绍最后简要介绍了一下如何使用TCL进行Quartus 流程的脚本方式运行
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.36mb
    • 提供者:付茗
  1. qts_qii52003

    0下载:
  2. Quartus II Tcl scr ipting说明文档,详细说明了在quartus中如何使用Tcl脚本进行快速开发。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:235.62kb
    • 提供者:杨开轶
  1. TCL_Training

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  2. Quartus II的TCL脚本的教程,对学Quartus非常有用。
  3. 所属分类:嵌入式/单片机编程

    • 发布日期:2008-10-13
    • 文件大小:603.88kb
    • 提供者:Jason
  1. 2008.09-scripts_only

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  2. synopsys icc 使用参考脚本-reference scr ipt of synopsys icc
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:81.7kb
    • 提供者:steven
  1. Simulation-D133

    0下载:
  2. 使用XML文件编写了使用与NS2的场景文件,利用这些场景文件编写TCL脚本对所需场景进行模拟仿真。-Prepared using the XML file to use with the NS2 scene files, use the scenes of writing TCL scr ipts for the required simulation scene.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-30
    • 文件大小:52.3kb
    • 提供者:rita
  1. 6soft_247MHz_channel

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  2. lte上行信道解交织解复用: RTL: ack_addr_gen.vhd ack地址产生 data_addr_gen.vhd 数据地址产生 de_interl_mux_con_ctrl.vhd 控制单元 de_interl_mux_con_top.vhd 顶层 de_interl_mux_con_tt.vhd 测试平台 de_mux_ram.vhd ram deinterl_pack.vhd 变量定义 delay.vhd 延迟 delayb.vhd 延迟
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:195.94kb
    • 提供者:renliang
  1. quartus_tcl_example

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  2. Quartus ii tcl/tk 脚本教程,全部是精华,方便网络不好的FPGA工程师参考。-Quartus ii tcl/tk scr ipt user guide, all very good for refrence, used while FPGA project.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-21
    • 文件大小:65.8kb
    • 提供者:wds
  1. windows-script

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  2. 在window平台,采用脚本TCL来编译fpga的经典例子。具体的写法,见工程中的ise_flow.bat文件。如果在工作站来处理更块-In the window platform, using classic example TCL scr ipt to compile the fpga. Specific wording, see the project ise_flow.bat file. If the workstation to handle more blocks
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:15.26kb
    • 提供者:成功
  1. xilinx-tcl

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  2. Xilinx脚本约束手册,从官方直接拿到的,对Xilinx FPGA开发很有用的。-Xilinx tcl handbook, directly got Xilinx。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2.45mb
    • 提供者:程云
  1. ug835-vivado-tcl-commands

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  2. Vivado是Xilinx最新的FPGA设计工具,支持7系列以后的FPGA及Zynq 7000的开发。与之前的ISE设计套件相比,Vivado可以说是全新设计的。无论从界面、设置、算法,还是从对使用者思路的要求,都是全新的。看在Vivado上,Tcl已经成为唯一支持的脚本,此文件是vivado是tcl命令的集合。(Vivado is Xilinx's latest FPGA design tool that supports development of FPGAs and Zynq 7000s
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-20
    • 文件大小:6.85mb
    • 提供者:独白惠茹
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