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  1. 9363

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  2. AD9363控制接口,在TDD模式下,cmos接口传输数据,数据率61.44MHz,时钟122.88MHz-ad9363 interface.tdd mode.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-11
    • 文件大小:6.09kb
    • 提供者:sgeb
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