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搜索资源列表

  1. av-p06a.rar

    1下载:
  2. 型号: AV-P06A 5.1CH功率放大器 89C52+12M+PT2314+PT2315+2*M62429+PT6311+CS16210+6221+VFDGDT1313A,包含VFD真值表手册资料,Model: AV-P06A 5.1CH power amplifier 89C52+ 12M+ PT2314+ PT2315+ 2* M62429+ PT6311+ CS16210+ 6221+ VFDGDT1313A, truth table VFD manual contains infor
  3. 所属分类:SCM

    • 发布日期:2014-05-20
    • 文件大小:429.1kb
    • 提供者:张绍斌
  1. vhdl1.rar

    0下载:
  2. 设计一个四路数据选择器,其功能是将四组不同的数据按要求选择一个输出.输出的那组数据有两个控制信号决定,其真值表如下: 数据选择控制端 输出的数据 Input0 Input1 output 0 0 output0 0 1 output1 1 0 output 2 1 1 output 3, Designs four ways according to the selector, its function is chooses four groups of different data accor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:27.12kb
    • 提供者:晨曦
  1. lab1_VHDL

    0下载:
  2. VHDL数字系统设计工程实践,包含实验的原理,真值表和结构图描述,以及相关的VHDL代码。-VHDL digital system design engineering practice, including the principle of the experiment, truth table and chart descr iptions, and associated VHDL code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:51.83kb
    • 提供者:wangfeijum
  1. lab2_VHDL

    0下载:
  2. VHDL数字系统设计和工程实践1,包含原理,真值表和原理图,以及VHDL源代码.-VHDL digital system design and engineering practice, one that contains principles, truth table and schematic, as well as VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:40.92kb
    • 提供者:wangfeijum
  1. state_machine

    0下载:
  2. 三进程有限状态机的设计程序,内附有AD574逻辑控制真值表以及采样状态机的原理图-Third, the process of finite state machine design process, logic control of typhoons and rainstorms are AD574 truth table, as well as sampling state machine schematic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:39.01kb
    • 提供者:lijq
  1. 74HC595-Application-with-MC51

    0下载:
  2. 595——8位数码管循环移位显示.doc │ 利用74HC595实现多位LED显示的新方法.doc │ 用74HC595芯片驱动LED的电路设计.pdf │ 文件目录表绘制.cmd │ 文件夹目录.txt │ 文件名目录.txt │ ├─点阵设计 │ 74HC595PW.pdf │ 正文点阵设计.doc │ ├─Use595_4(Alexi) │ Use595_2.c │ Use595_4.hex │ Use595_4(Alexi).
  3. 所属分类:SCM

    • 发布日期:2017-03-28
    • 文件大小:752.32kb
    • 提供者:Alexi
  1. 4511

    0下载:
  2. 4511介绍包含引脚 逻辑图 真值表 功能图-4511 introduced the truth table contains the pin function chart logic diagram, etc.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-16
    • 文件大小:277.53kb
    • 提供者:aphrodite
  1. Scm002

    0下载:
  2. HT1621驱动一款LCD~不管主要是处理真值表的方法-HT1621-driven LCD ~ regardless of a major method of dealing with truth table
  3. 所属分类:SCM

    • 发布日期:2017-03-30
    • 文件大小:95.56kb
    • 提供者:李浩然
  1. lab3_VHDL

    0下载:
  2. VHDL数字系统设计和工程实践2,包含原理,真值表和原理图,以及VHDL源代码.-VHDL digital system design and engineering practice, one that contains principles, truth table and schematic, as well as VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:47.38kb
    • 提供者:wangfeijum
  1. lab4_VHDL

    0下载:
  2. VHDL数字系统设计和工程实践2,包含原理,真值表和原理图,以及VHDL源代码.-VHDL digital system design and engineering practice, one that contains principles, truth table and schematic, as well as VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:22.62kb
    • 提供者:wangfeijum
  1. lab5_VHDL

    0下载:
  2. VHDL数字系统设计和工程实践3,包含原理,真值表和原理图,以及VHDL源代码.-VHDL digital system design and engineering practice, 3, including the principles, truth table and schematic, as well as VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:6.3kb
    • 提供者:wangfeijum
  1. lab6_VHDL

    0下载:
  2. VHDL数字系统设计和工程实践5,包含原理,真值表和原理图,以及VHDL源代码.-VHDL digital system design and engineering practice 4, including the principles, truth table and schematic, as well as VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:171.15kb
    • 提供者:wangfeijum
  1. lab7_VHDL

    0下载:
  2. VHDL数字系统设计和工程实践6,包含原理,真值表和原理图,以及VHDL源代码.-VHDL digital system design and engineering practice, six, including the principles, truth table and schematic, as well as VHDL source code.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:74.08kb
    • 提供者:wangfeijum
  1. seven

    0下载:
  2. 基于VHDL实现输入控制7段数码管的代码,分别用逻辑表达式法和真值表法实现。-VHDL-based implementation of digital control input control 7-segment code, respectively, a logical expression method and truth table method to achieve.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:738byte
    • 提供者:cckaa
  1. 7SEG-VHDL

    0下载:
  2. 7段数码管的设计与实现 用真值表法和逻辑表达式两种-7 Design and implementation of digital control and logic expressions with a truth table of two
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:35.45kb
    • 提供者:YeZiqiang
  1. bb

    0下载:
  2. 2选1的数据选择器 实现2选1的电路功能,其真值表和电路符号如下图所示。即当s=1时,输出m=y;当s=0时,输出m=x。 -2 Select a data selector circuit to achieve 2 S 1 function, its truth table and circuit symbols shown below. That is, when s = 1, the output m = y when s = 0, the output m = x.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.09kb
    • 提供者:潘小丽
  1. CFAH1602BTMCJP

    0下载:
  2. DE2开发板上LCD显示器的工作原理说明,包括显示器的真值表,以及字符库的调用方法。-DE2 development board and LCD display shows the working principle, including the display of the truth table, and character library method call.
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:207.79kb
    • 提供者:陶陶
  1. HDL-DE-KE-ZHONGHE-JIANJIE

    0下载:
  2. 分析:制定规范 􀁺 设计:状态图,真值表,编写代码。 􀁺 验证:证明电路的正确性。仿真和形式化验 证。 􀁺 综合:高层次到低层次转换。生成网表 􀁺 测试:发现废品。生成测试向量-Analysis: norm 􀁺 design: state diagram, truth table, write the code. 􀁺 Authentication: proof of the c
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:196.33kb
    • 提供者:zhujizhen
  1. ch01

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  2. 1 bit comparator Consider a 1-bit equality comparator with two inputs, i 0 and ii, and an output, eq. The eq signal is asserted when i0 and il are equal truth table: input output iOil eq 0 0 1 0 1 0 1 0 0 1-1 bit comparator Con
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:1.38kb
    • 提供者:Neeraj Sharma
  1. nand_2

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  2. 在Quartus II中用VHDL语言编写的用真值表来实现的与非门电路程序。-In Quartus II using VHDL language with the truth table to achieve the non-gate process.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:158.43kb
    • 提供者:林燕
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