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搜索资源列表

  1. ADC_DAC

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  2. This example streams input from a ADC source to a DAC. An analog signal is acquired block-by-block into SDRAM from the ADC (an AD9244 in this example). The frames are then output with a one-frame delay to the DAC (an AD9744 in this example). I
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:23993
    • 提供者:gaofeng
  1. sha1

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  2. sha1算法,SHA1算法可以对任意位长的数据压缩,形成160 bit 值。 处理单位是 以512BIT的数据块 -sha1 algorithm, SHA1 algorithm can be arbitrary bit length data compression, the formation of 160 bit value. The data processing unit block is 512BIT
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-06
    • 文件大小:5219
    • 提供者:郭先生
  1. sheji

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  2. 本科毕设,基于cpld的光栅信号处理,包含源代码和模块框图-Undergraduate Bi is located, based on cpld grating signal processing, including source code and block diagram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:30748
    • 提供者:紫溪
  1. aludesign

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  2. In computing, an arithmetic logic unit (ALU) is a digital circuit that performs arithmatic and logical operations. The ALU is a fundamental building block of the central processing unit of a computer, and even the simplest microprocessors contain one
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:838
    • 提供者:gopan
  1. CAN_USB

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  2. 该控制系统原理框图见图2。摩托车底盘测功机通过CAN数据采集节点对系统的数据进行采集,然后通过USB接口送入PC机进行处理,然后PC机通过CAN控制节点对摩托车底盘测功机进行控制。图2是一个简化的系统,在实际应用的时候还可以进行扩展。如燃油消耗量、排放污染物、摩托车滑行以及加速性能等参数的测量都可以扩展到基于CAN总线的数据采集系统里面。-The control system block diagram shown in Figure 2. Motorcycle chassis dynamome
  3. 所属分类:SCM

    • 发布日期:2017-03-27
    • 文件大小:100812
    • 提供者:伍世祺
  1. 61IC_H5530

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  2. AD7715驱动原代码,对20bitAD块数据采集,单片机数据处理-AD7715 driver source code, to 20bitAD block data collection, data processing microcontroller
  3. 所属分类:SCM

    • 发布日期:2017-04-13
    • 文件大小:2277
    • 提供者:wang
  1. abc

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  2. 单字节无符号数据块排序原理与设计及中断方式串口处理方法-Unsigned single-byte data block sorting principle and design and interrupt serial processing
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-14
    • 文件大小:4613
    • 提供者:卢方
  1. alu

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  2. In computing, an arithmetic logic unit (ALU) is a digital circuit that performs arithmetic and logical operations. The ALU is a fundamental building block of the central processing unit (CPU) of a computer, and even the simplest microprocessors conta
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:2412
    • 提供者:Andrew
  1. test_sdram

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  2. 对SDRAM进行读写,工程内部分为PLL以及复位处理模块、写SDRAM逻辑模块、读SDRAM逻辑模块、SDRAM读写封装模块、读写缓存FIFO模块、串口发生模块等。工程基于altera的Quartus II 10.1进行设计,使用更高版本的软件均可。-SDRAM read and write for the project is divided into the internal PLL and reset processing module, SDRAM write logic block,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3128831
    • 提供者:
  1. gr-my-blocks-template

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  2. design a basic signal processing block. Templates to create new blocks
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:235880
    • 提供者:piaoling
  1. Design_of_a_Basic_Block

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  2. book about design a basic signal processing block.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:104907
    • 提供者:piaoling
  1. FPGA_ARINC_429_design

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  2. 机载数据总线ARINC 429在当代的运输机和相当数量的民用客机中有着广泛的应用。目前国内的专用ARINC 429信号处理芯片一般路数有限,要实现多通道的信息处理,就需要多块类似的芯片,从而体积就会变的比较庞大,非常不灵活。,因此利用FPGA和DSP相结合,设计和研制的ARINC 429总线信号处理板,成为目前飞机机载总线接口研究的重点,具有非常重要的现实意义和应用前景。 -The airborne data bus, ARINC 429 has a wide range of modern
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:130246
    • 提供者:forest
  1. Implmntnof-vectrcntrl-TMS320F240DSP

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  2. A digital signal processor (DSP) is a specialized microprocessor (or a SIP block), with its architecture optimized for the operational needs of digital signal processing. The goal of DSPs is usually to measure, filter and/or compress continuous real-
  3. 所属分类:DSP program

    • 发布日期:2017-04-30
    • 文件大小:381710
    • 提供者:Navageeth Sethu
  1. DSP_zusaijuzhen

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  2. 在DSP5509A开发环境下,进行运用阻塞矩阵方法进行语音信号增强处理。-In the DSP5509A development environment, the speech signal enhancement processing is carried out by using the block matrix method.
  3. 所属分类:DSP program

    • 发布日期:2017-05-04
    • 文件大小:500549
    • 提供者:蒋茂松
  1. verilog

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  2. 本文档设计了1光栅位移传感器信号的接收、光栅位移传感器信号的整形及电平转换电路设计,用Verilog HDL描述了锁相倍频细分和零位信号处理电路。利用FPGA实现光栅位移系统与上位机接口的电路原理框图-This document designed a grating displacement sensor signal reception, grating displacement sensor signal shaping and level conversion circuit design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:108298
    • 提供者:吴汉
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