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搜索资源列表

  1. verilog_usbblaster

    0下载：
  2. 用verilog编写的USB下载线程序 实现USB协议和JTAG接口的数据转换实现状态机

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：1.5mb
    • 提供者：一王

  1. USB_jtag

    0下载：
  2. 用verilog编写的USB下载线程序 实现USB协议和JTAG接口的数据转换实现状态机。

  3. 所属分类：VHDL编程

    • 发布日期：2008-10-13
    • 文件大小：1.5mb
    • 提供者：霍飘摇

  1. JTAG_timing

    0下载：
  2. 用VHDL实现的JTAG时序，其中有16个状态机来控制产生该时序。-jtag timing implemented by VHDL

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-04
    • 文件大小：33.75kb
    • 提供者：liuqi

  1. jtag fsm

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  2. jtag接口的状态机实现，李庆华《通信IC设计》随机代码(State machine implementation of JTAG interface)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-18
    • 文件大小：2kb
    • 提供者：xilingsnow
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