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搜索资源列表

  1. my_second_fpga

    0下载：
  2. 用Quartus ii13.0写的二进制加法器，使用了IP核RAM，以及LCD显示，打开就能直接使用。-Using Quartus ii13.0 write binary adder, using the IP core RAM, and LCD display, open can be used directly.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-21
    • 文件大小：6054071
    • 提供者：

  1. LED

    0下载：
  2. 利用QuartusⅡ IPCore实现循环点亮LED.-Use Quartus Ii IP Core for recycling lit LED.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-07
    • 文件大小：1286222
    • 提供者：xh

  1. pic10

    0下载：
  2. 本文件夹里面的是实现pic10 CPU的全部verilog代码以及相应的测试脚本代码，当然有一些模块是在quartus中直接编辑波形测试的，所以没有响应的测试脚本文件。 tri_state_port的测试还未完成，test_pic10_status_reg.vt和test_pic10_tri_state_port2.vt都没有完成测试任务 其中有三篇文档： PIC10_RISC_Design.pdf:原文（verilog代码基本都来自原文，对一部分进行了改进），这篇文章写

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-14
    • 文件大小：3458159
    • 提供者：Eddie

  1. spram

    1下载：
  2. verilog编写的spram，包含顶层模块，控制模块和spram本体，其中spram为Altera提供的ip核，已在quartus 16上运行通过(Verilog written in spram, including the top-level module, control module and spram ontology, where spram is the IP kernel provided by Altera, has been running on quartus 16)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-26
    • 文件大小：2857984
    • 提供者：keykai

  1. exp_fft_test_724

    0下载：
  2. 在quartus软件中调用FFT的IP核，编辑IP核的驱动模块，使得IP核读入数据进行处理，输出数据。使用modelsim进行联合仿真。(In the quartus software, the IP kernel of FFT is called, and the driver module of the IP kernel is edited, so that the IP kernel is read into the data for processing and output data

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2018-04-29
    • 文件大小：27558912
    • 提供者：XHF72
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