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  1. calc_v2_s3eboard

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  2. Simple calculator EDK design implemented on Digilent S3EBOARD using Microblaze soft-core CPU. Input: PS/2 keyboard, output: VGA monitor.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-05-11
    • 文件大小：2.82mb
    • 提供者：madcrow

  1. RECURSIVEALGORITHMFOREFFICIENTMAPDECODING

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  2. Early termination enables powering down parts of the soft-input soft-output (SISO) equalizer and decoder thereby saving power.

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-04-06
    • 文件大小：101.84kb
    • 提供者：suresh

  1. 06033714

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  2. 软输入软输出维特比卷积译码,他列出那怎么进行编码和译码以及要求符合的条件-soft input soft output convolutional codes

  3. 所属分类：SCM

    • 发布日期：2017-04-16
    • 文件大小：148.82kb
    • 提供者：吴海文
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