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  1. chaoche

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  2. 基于FPGA的Verilog HDL编写的黑线控制小车直线,及检测黑线延迟减速的设计。-FPGA-based Verilog HDL prepared to control the car straight black lines, and testing the black wire delay reducer design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:408.37kb
    • 提供者:姜敏敏
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