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  1. lab5_

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  2. 这是在vhdl开发环境下模拟D-FLI FLOP,T-FLIP FLOP 和 JK-flip flop。其中包含testbench 源码。-This is the vhdl development environment simulation D-FLI FLOP, T-FLIP FLOP and JK-flip flop. Which contains the testbench source.
  3. 所属分类:SCM

    • 发布日期:2017-11-15
    • 文件大小:377.57kb
    • 提供者:rendy
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