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LCD_Controller_Altera_MAX_II_CPLD
- 基于MAXII CPLD的对1602字符型液晶进行读写操作，其中使用了一个CFI的IP核
q_sys
- PCIe ip核。使用Quartus II 11.0，在Altera开发板4cgx15上验证通过。-PCIe ip core. Using the Quartus II 11.0, in the Altera development board 4cgx15 verify through.
CANbus
- 主要是说明can总线协议使用fpga的ip核实现，供使用can总线的人使用-Mainly states can use the FPGA bus protocol of the ip nuclear realized, for people who use the bus can use
29becbce-7f76-454c-9f85-fb6138f83375
- cpu IP 核设计的verilong代码-cpu IP core design code verilong
DW8051(Verilog)
- 51单片机IP核源码，可以在fpga实现，并进行仿真与验证-51 single-chip IP nuclear source, you can achieve the fpga, and simulation and verification
VHDLAVRIPcore
- 使用VHDL语言写的AVR单片机IP核， 可以直接使用，已经经过验证， 十分珍贵哦-Written in VHDL language using the AVR microcontroller IP core, can be used directly, has proven very valuable oh
AlterA8237IPcoreshost
- Altera公司可编程DMA控制器A8237的IP核host_dec模块-Altera, The Programmable DMA controller IP core host_dec module A8237
51fpga
- 51单片机 IP核 FPGA CPLD 基于EDA技术的兼容MCS_51单片机IP核设计- FPGA CPLD
51IPcore
- 很强 的的一份关于单片机ip核的，一般人我不告诉他-A very strong nucleus on the MCU ip, most people I did not tell him ...
sram_lcm
- 该代码是基于NIOSii软件在QUARTUS上上自制IP核并在DE2开发板实现图片的显示。-The code is based on NIOSii software QUARTUS made on the IP core and on the DE2 board to achieve the picture display.
W7100A
- 带IP核的单片机W7100A的底层驱动代码，一些基础网络通信协议，包括套接字等。-With IP core of single chip microcomputer W7100A underlying driver code, some basic network communication protocols, including socket, etc.
LCD
- 本实验通过使用 SOPC Builder 搭建一个包含cpu、ram、sdram、pio、lcd定制ip核、jtag _uart”的SOPC系统。 1.通过该系统实现在eclipse的调试串口上显示字符的功能。 2.通过该nios处理器的pio实现流水灯的效果。 3.通过该系统实现在1602液晶上的字符显示。