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qep_data_bus
- 基于地址总线接口的四倍频编码器信号接口的 FPGA实现 Verilog HDL的-address bus interface based on the four frequency signal encoder interface FPGA Verilog HDL
light_telegraphic_code_four_frequency
- 实光电码盘的输出数据的四倍频，使码盘输出精度提高四倍。-real photoelectric encoder output data of the four frequency, accuracy encoder output increased by four times.
beipin_4
- 自己编写的vhdl语言来实现的四倍频电路，自我感觉还可以，也通过了编译，如果有需要就下载去看看吧-prepared vhdl own language to achieve the four frequency circuit, a sense of self, can also, through a compiler, If there is a need to look at the downloaded Look here
altpll0
- 锁相环的使用 可以倍频或者分频 可以最多四个输出-Your use of Altera Corporation s design tools, logic functions --and other software and tools, and its AMPP partner logic --functions, and any output files from any of the foregoing --(including device programmin
encoder
- 编码器信号处理 经过倍频器进行四倍频 后 同时完成鉴相 计数-the encoder single program
Freq_4
- 伺服电机编码器四倍频源程序，已经在工程中应用。非常有用。-it is important,it has been use in my project.i hope it is useful to everyone
52250440605_AB
- 基于CPLD 的光电脉冲码盘 信号四倍频电路设计-CPLD-based electro-optical pulse encoder signals four multiplier circuit design
encoder_interface
- 正交编码器接口 用于正交四倍频电路 伺服驱动器常用-Quadrature Encoder Interface circuit for quadrature servo drives commonly used frequency
CPLD
- CPLD编程，处理两路编码器的信号，可以将信号四倍频。同时能够控制IO的输入输出信号。-cpld program
AB-4F
- 基于CPLD 的四倍频辩向电路设计-24位计数 8位单片机数据输出-Based on the CPLD optical pulse encoder signal multiplier circuit design
eda
- EDA 正弦信号发生器：正弦信号发生器的结构有四部分组成，如图1所示。20MHZ经锁相环PLL20输出一路倍频的32MHZ片内时钟,16位计数器或分频器CNT6，6位计数器或地址发生器CN6，正弦波数据存储器data_rom。另外还需D/A0832（图中未画出）将数字信号转化为模拟信号。此设计中利用锁相环PLL20输入频率为20MHZ的时钟，输出一路分频的频率为32MHZ的片内时钟，与直接来自外部的时钟相比，这种片内时钟可以减少时钟延时和时钟变形，以减少片外干扰 还可以改善时钟的建立时间和保持时
sclock
- 实现四种不同分频，分别是10000,1000,100,10倍分频-Four different sub-band, respectively 10000,1000,100,10 times divider
fpxz
- 分频选择系统。inclk0端输入25MHz信号，通过altpll倍频为400MHz信号C0端输出，需求不一样自己改倍频器参数。分频器clkdiv用来二分频、四分频、八分频、十六分频，分别分频为200MHz、100MHz、50MHz、25MHz四种频率信号输入到选择器中。选择器的TCLK是外部输入信号，A[3..0]是四个独立按键，选择器是用按键的不同组合来从四个分频喜好和一个TCLK中选择一路输出。代码清晰易懂，不符合需求请自行扩展-Frequency selection system. the
pinlvji_LCD1602
- 一个完整的已经过测量和验证的VHDL程序，测量范围从1Hz到1GHz的频率计，也可以当做计数器，通过LCD1602显示频率值，四路独立按键可以控制输出不同的频率值、控制对应的独立LED亮灭、控制蜂鸣器发声。输入的晶振频率是25MHz,不符合请自行在倍频器中更改参数。-Has been a complete VHDL program measurement and verification, measurement range from 1Hz to 1GHz frequency counter
js
- 绞车传感器的计数程序代码 计算四倍频的程序 -Winch sensor count code to calculate the fourth harmonic of the program
rligght_telege
- 实光电码盘的输出数据的四倍倍频，使码盘输出精度提高四倍。-Four times the multiplier of the output data of the real optical encoder, the encoder output precision increased by four times.
myproj
- 1) 可以产生四种波形：正弦波，方波，三角波，锯齿波。 2) 实现分频可调，分频比从2~256可调，通过两个按键进行+1和-1的调整。 3) 信号幅度可调，幅度增益从1~4倍可调，过两个按键进行+1和-1的调整。 4) 8位数码管的前3位显示分频比，最后一位显示幅度增益，中间的四位分别代表四种波形是否输出，若输出则显示’1’,否则显示’0’。 5) 可实现四种波形的叠加，当有两种波形叠加时，增益不能超过3，当是四种或三种波形叠加时，增益只能为1. -1) can produc
count_5
- 5路光栅信号的数字滤波、四倍频、同步锁存、计数-5-way digital filtering raster signal, quadrupled synchronous latch count