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  1. verilog

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  2. 基于Verilog HDL的通信系统设计一书的电子教案,里面有很多例子,大家可以参考一下-Verilog HDL-based communication system design e-book lesson plans, there are many examples we can refer to
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.74mb
    • 提供者:
  1. REACH

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  2. 基于VHDL的异步串行通信电路设计 随着电子技术的发展,现场可编程门阵列FPGA和复杂可编程逻辑器件CPLD的出现,使得电子系统的设计者利用与器件相应的电子CAD软件,在实验室里就可以设计自己的专用集成电路ASIC器件。这种可编程ASIC不仅使设计的产品-VHDL-based asynchronous serial communication circuit design with the advent of electronic technology, field programmable g
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.66kb
    • 提供者:chaiyiming
  1. CORDIC

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  2. 数字控制振荡器(NCO,numerical controlled oscillator)是软件无线电、直接数据频 率合成器(DDS,Direct digital synthesizer)、快速傅立叶变换(FFT,Fast Fourier Transform) 等的重要组成部分,同时也是决定其性能的主要因素之一,随着芯片集成度的提高、在信号 处理、数字通信领域、调制解调、变频调速、制导控制、电力电子等方面得到越来越广泛的 应用。-Digital controlled oscilla
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:4.07kb
    • 提供者:司令
  1. englishword

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  2. 这是电子通信行业fpga应用英文缩略语表,对工程技术人员有很高的参考价值-english words
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:11.62kb
    • 提供者:vann
  1. IEEE_standard_verilog

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  2. 其中,Verilog硬件描述语言(HDL)的定义,在这个标准。 Verilog的HDL是一个正式的符号中的电子系统创建的各个阶段使用。因为它既是机读和人类可读的,它支持开发,验证,综合,硬件设计和测试,对数据通信的硬件设计,以及维修,改装和硬件采购。这个标准的主要对象是工具的实现者支持的语言和语言的高级用户。-The Verilog Hardware Descr iption Language (HDL) is defined in this standard. Verilog HDL is a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:3.97mb
    • 提供者:zhong
  1. DSPprincipalandapplication

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  2. 对通信,电子信息语音传输处理,和dsp应用中一些常用芯片功能,结构,有点,劣势介绍-Of communication, voice transmission of electronic information processing, and application of some common chips dsp function, structure, little, inferior Introduction
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.63mb
    • 提供者:fengwenjiong
  1. HARP

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  2. 电子琴,播放音乐,电子通信工程系作业上课作业-Keyboard, playing music, electronic communication engineering job class job
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:859.14kb
    • 提供者:ru
  1. musicplayer_full_func_1c3

    0下载:
  2. 音乐播放器,电子通信工程系作业,一首歌曲-Music players, electronic communication engineering jobs, a song
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:503.02kb
    • 提供者:ru
  1. task2

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  2. Verilog语言,可在QuartusII正确运行,实现远程控制系统,利用异步串行通信,PC发送数据FPGA接收,实现本地回环模式。-清华大学电子课程设计:Verilog language, you can QuartusII correctly, remote control systems, using asynchronous serial communication, PC to send data received FPGA to achieve the local loopback
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:558.94kb
    • 提供者:薛芬
  1. task22constant

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  2. 清华大学电子课程设计:Verilog语言,Quartus可以正确运行,下载到FPGA上可完成PC与FPGA一串数据的连续收发,且实现本地回环,异步串口通信-Verilog language, Quartus can be correctly downloaded to the FPGA to be completed by PC and FPGA transceivers continuous string of data, and implement local loop, asynchron
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:566.77kb
    • 提供者:薛芬
  1. UESTC_VHDL_PPT

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  2. 电子科大通信抗干扰实验室何旭老师的VHDL课程-Electronic Science and Technology Laboratory He Xu teacher communication interference VHDL course
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:68.52kb
    • 提供者:杨光
  1. NIOSII_logic

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  2. 我曾经参加过电子设计,所以传一些以前的作品,大家看一下。这是一个居于NIOS和FPGA的嵌入式逻辑分析仪中nios的所有程序,里面包含彩屏程序,sd卡读取程序,以及gui式的设计界面,这大大节省了资源,克服了传统单片机和FPGA的通信的问题。大家可以借鉴一下,个人感觉用嵌入式来设计会方便多了。-longic base on nios and fpga ,ucgui
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.66mb
    • 提供者:林铭团
  1. pwm_led

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  2. 脉冲宽度调制(PWM),是英文“Pulse Width Modulation”的缩写,简称脉宽调制,是利用微处理器的数字输出来对模拟电路进行控制的一种非常有效的技术,广泛应用在从测量、通信到功率控制与变换的许多领域中。 随着电子技术的发展,出现了多种PWM技术,其中包括:相电压控制PWM、脉宽PWM法、随机PWM、SPWM法、线电压控制PWM等 本程序是利用PWM进行DA转换控制 -Pulse width modulation (PWM), the abbreviation of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:652byte
    • 提供者:wql
  1. caitiao

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  2. 彩条发生器的源程序,适合电子通信的eda课程设计。-The source of the color bar generator, suitable for electronic communications the eda course design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:2.41kb
    • 提供者:刘月
  1. rs232

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  2. 串口传输,传输协议为RS232。RS-232C标准是美国EIA(电子工业联合会)与BELL等公司一起开发的1969年公布的通信协议。-Serial transmission, the transmission protocol for RS232. RS-232C standard communication protocol is developed with the EIA (Electronic Industries Association) BELL companies in the U
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-08
    • 文件大小:3.21kb
    • 提供者:陈恺
  1. qpskddc

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  2. fpga实现dds和下变频。DDS 技术具有频率切换时间短,频率分辨率高,频率稳定度高,输出信号的频率和相位可以快速切换,输出相位可连续,并且在改变时能够保持相位的连续,很容易实现频率、相位和幅度的数字控制。它在相对带宽、频率转换时间、相位连续性、高分辨率以及集成化等一系列性能指标方面远远超过了传统频率合成技术。因此在现代电子系统及设备的频率源设计中,尤其在通信领域,直接数字频率合成器的应用越来越广泛。-fpga implementation dds and downconversion. DD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.33mb
    • 提供者:lvhenan
  1. ca_code

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  2. nco的产生原理的相关代码;软件无线电、直接数据频 率合成器(DDS,Direct digital synthesizer)、快速傅立叶变换(FFT,Fast Fourier Transform) 等的重要组成部分,同时也是决定其性能的主要因素之一,用于产生可控的正弦波或余弦波。随着芯片集成度的提高、在信号 处理、数字通信领域、调制解调、变频调速、制导控制、电力电子等方面得到越来越广泛的应用-nco the generation principle of the relevant code s
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:711byte
    • 提供者:李毅
  1. VHDLRS232Slave

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  2. 本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。程序实现了一个收发一帧10个bit(即无奇偶校验位)的串口控 //制器,10个bit是1位起始位,8个数据位,1个结束 //位。串口的波特律由程序中定义的div_par参数决定,更改该参数可以实 //现相应的波特率。程序当前设定的div_par 的值是0x145,对应的波特率是 //9600。用一个8倍波特率的时钟将发送或接受每一位bit的周期时间 //划分为8个时隙以
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.4kb
    • 提供者:yanganggang
  1. edc_spi

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  2. 电子设计竞赛中,单片机和FPGA的串口通信程序,性能经过测试比较稳定-Electronic Design Contest, the microcontroller and FPGA serial communication program, more stable performance tested
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.76mb
    • 提供者:张兴
  1. DDS

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  2. 基于FPGA完成2001年电子设计竞赛直接数字频率合成器,有FPGA部分、MSP430程序以及相互通信的程序,完成题目全部要求-FPGA-based Electronic Design Competition 2001 complete direct digital frequency synthesizer, there is part of the program FPGA, MSP430 procedures and communicate with each other, to comp
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5.32mb
    • 提供者:
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