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  1. watchdog

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  2. 看门定时Verilog源码;用于MCU的辅助模块,定时特定的时间来做硬件复位,是用于避免固件跑死的一个机制。-Watchdog verilog source.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:4.24kb
    • 提供者:郑佛少
  1. jlprogram

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  2. 基于单片机的温度浓度周期测试时间与空气中的浓度测量相比,发送数据!温度不断更新!看门定时!计数T0等功能-Microcontroller-based temperature concentration cycle testing time compared with air concentration measurement sent! Temperature is constantly updated! Within the watchdog timer! Counter t0
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:382.57kb
    • 提供者:zdc
  1. MSP430-foundation-program-summary

    0下载:
  2. MSP430基础程序汇总,包括:I/O端口、基础时钟模块、TimerA/B、UART、看门定时、比较、FLASH、ADC等-MSP430-based summary of the program, including: I/O ports, the basic clock module, TimerA/B, UART, watchdog timer, comparators, FLASH, ADC, etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:463.23kb
    • 提供者:天下
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