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  1. altera的IP源码

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  2. Altera的IP源码8259,只需打开就能实现-Altera IP source 8259, will be realized only open
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:149399
    • 提供者:王天权
  1. UART 源码 (lattice version)

    0下载:
  2. UART 源码 (lattice version)-UART source (lattice version)
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:87131
    • 提供者:了类似
  1. 循环冗余校验码

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  2. 循环冗余校验码(试验报告)-Cyclic Redundancy Check (pilot reports)
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:51050
    • 提供者:振臂
  1. 异步FIFO的VERILOG实现(格雷码)

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  2. 使用格雷码实现异步FIFO
  3. 所属分类:VHDL编程

  1. VHDL编写的walsh码产生程序

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  2. VHDL语言编写的产生walsh码程序.
  3. 所属分类:VHDL编程

  1. DS18B20温度传感器VerilogHDL源码

    0下载:
  2. DS18B20温度传感器VerilogHDL源码,用于控制单线温度传感器DS18B20。
  3. 所属分类:VHDL编程

    • 发布日期:2010-08-17
    • 文件大小:443105
    • 提供者:hy2007@163.com
  1. (2,1,3)卷积码编解码

    4下载:
  2. (2,1,3)卷积码编解码,viterbi译码
  3. 所属分类:VHDL编程

    • 发布日期:2010-10-28
    • 文件大小:3343838
    • 提供者:zhaohua5269
  1. FPGA上实现TURBO码的编码

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  2. 在赛灵思的FPGA上实现的TURBO码的编码程序
  3. 所属分类:VHDL编程

  1. 以太网10-100M IP核Verilog源码

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  2. 以太网10-100M IP核Verilog源码,可综合
  3. 所属分类:VHDL编程

  1. 巴克码

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  2. 巴克码是一种具有特殊规律的二进制码组。它是一个非周期序列,一个n位的巴克码{X1,X2,X3,···Xn。),每个码元只可能取值十1或一1
  3. 所属分类:VHDL编程

  1. 8路视频光端机的VHDL源码

    1下载:
  2. 8路视频光端机的VHDL源码
  3. 所属分类:VHDL编程

    • 发布日期:2011-02-12
    • 文件大小:301110
    • 提供者:hudongsheng
  1. ECC校验FPGA源码

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  2. ECC校验FPGA源码,VHDL编写
  3. 所属分类:VHDL编程

    • 发布日期:2011-06-28
    • 文件大小:6451
    • 提供者:concoct
  1. EBCOT Processor 源码

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  2. 硬件实现JPEG2000 EBCOT 编码的源码
  3. 所属分类:VHDL编程

    • 发布日期:2011-11-21
    • 文件大小:4115646
    • 提供者:seanking88
  1. 基于vhdl的二进制转BCD码的设计

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  2. 基于vhdl的二进制转BCD码的设计,已经经过调试,可直接使用,Vhdl based on binary code to BCD design, has been testing can be used directly
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-27
    • 文件大小:801
    • 提供者:郭帅
  1. ASCII-to-HEX.ASCII码转十六进制数

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  2. labview程序:ASCII码转十六进制数,非常实用的程序,labview procedures: ASCII code to hexadecimal number, a very useful procedure
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-22
    • 文件大小:7605
    • 提供者:辛方
  1. 11位巴克码序列峰值检测器

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  2. (1)能够检测巴克码序列峰值; (2)在存在1bits错误情况下,能够检测巴克码序列峰值 (3)具体说明参见说明文档((1) the spike sequence of Barker code can be detected; (2) the spike sequence of Barker code can be detected under the condition of 1bits error)
  3. 所属分类:VHDL/FPGA/Verilog

  1. 二进制码转化为BCD码源程序

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  2. 二进制码转化为BCD码源程序,VHDL在FPGA验证(Conversion of binary code into BCD code source program)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-11
    • 文件大小:10240
    • 提供者:zhanglei123456
  1. BCD码转化为七段码源程序

    0下载:
  2. BCD码转化为七段码源程序。VHDL在FPGA验证(Conversion of BCD code into seven segment code source program)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-01-11
    • 文件大小:9216
    • 提供者:zhanglei123456
  1. 扰码器Verilog

    0下载:
  2. 实现扰码的功能,主要为64位在pcs子层传输的扰码器设计(To achieve the functions of scrambling code)
  3. 所属分类:VHDL/FPGA/Verilog

  1. labview vision例程包含源码

    0下载:
  2. labview vision 例程源码,含有好多例子。对初学者有很大帮助!
  3. 所属分类:VHDL编程

    • 发布日期:2018-11-01
    • 文件大小:10805163
    • 提供者:624512809@qq.com
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