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DSPBuilderFIR.files
- 在信息信号处理过程中,如对信号的过滤、检测、预测等,都要使用滤波器,数字滤波器是数字信号处理(DSP,DigitalSignalProcessing)中使用最广泛的一种器件。常用的滤波器有无限长单位脉冲响应(ⅡR)滤波器和有限长单位脉冲响应(FIR)滤波器两种[1],其中,FIR滤波器能提供理想的线性相位响应,在整个频带上获得常数群时延从而得到零失真输出信号,同时它可以采用十分简单的算法实现,这两个优点使FIR滤波器成为明智的设计工程师的首选,在采用VHDL或VerilogHDL等硬件描述语言设
DCT_1D
- 一维DCT变换的verilog源码,可用于JPEG算法优化的参考。程序中用到的算法称为“扭卷积”,可参考相关IEEE paper
BFD.rar
- 针对SOC测试环优化的BFD算法源代码。得到各个IP核在不同TAM宽度下的测试时间。,BFD Algorithm source code based SOC wrapper optimization
DSPAlgorithms
- 数字信号处理算法的优化以及硬件描述语言实现-DSPAlgorithms
median-filter
- 基于FPGA的图像中值滤波算法的优化及实现vhdl-中值滤波 利用VHDL语言实现三级流水线中值滤波-FPGA-based image filtering algorithm optimization and realization of vhdl-median filter using VHDL language three pipelined median filter
Verilog000
- FPGA的学习,熟悉QuartusII软件的各种功能,各种逻辑算法设计,接口模块(RS232,LCD,VGA,SPI,I2c等)的设计,时序分析,硬件优化等,自己开始设计简单的FPGA板子。 ③、NiosII的学习,熟悉NiosII的开发流程,熟悉开发软件(SOPC,NiosII IDE),了解NiosII的基本结构,设计NiosII开发板,编写NiosII C语言程序,调试板子各模块功能。-Verilog语言的学习,熟悉Verilog语言的各种语法。 ②、FPGA的学习,熟悉
TDvedynausermanual
- ve-DYNA® 为用户提供了车辆动力学、车辆非线性行为的可配置仿真模型。用户根据自己的工程问题选择合适的车型(轿车,货车,拖车)和适当的版本(低级,标准,高级)就能实现不同的应用。用户基于模型就能开发自己的控制算法或者部件,然后通过离线仿真和硬件在回路仿真来进行检验和验证。只需要进行鼠标键盘的操作,就可以对种种的动力学问题进行分析,比如悬架动力学,车辆动力性或操纵稳定性。这样 就 能够减少昂贵而且费时甚至是危险的实车试验。可以在无人监控的情况下完成整个的测试、优化和系统验证 。本文为v
CORDIC_FPGA
- 摘要:本文在传统CORDIC算法的基础之上,通过增加迭代次数,对参数进行了优化筛选, 提高了运算精度,使设计出的软核能够在精度要求较高的场合中运行,如实时语音、图 像信号处理、滤波技术等。输出数据经过IEEE-754标准化处理,能够直接兼容大多数处 理器,扩展了其应用范围。最终在Altera公司NiosⅡ处理器中通过增加自定义指令的方 式完成了硬件实现。 关键字:CORDIC ,自定义指令, IEEE-754标准化处理。-Abstract: In this paper, ba
DA_fir_parrel
- 用FPGA实现并行分布式算法的VHDL程序,采用优化结构实现,功能正确-FPGA implementation using VHDL program parallel and distributed algorithms, realized by optimizing the structure and function correctly
h264_2008
- 编解码的算法优化研究及FPGA的硬件实现-encoder fpga
my
- 64位数据的CRC-32校验的,Verilog实现,算法并行优化-64-bit data CRC-32 checksum, Verilog implementation of a parallel optimization algorithm
2222
- 内预测算法优化及几个重要模块的FPGA实现-Prediction algorithm to optimize and in several important modules of the FPGA realizing
optimizehighaccuracysignalgenerator
- 本文描述了关于高精度信号发生器的优化算法-this paper describe how to optimize high accuracy signal generator
myfft64_final
- 通过调用quartus ii中的宏模块,优化源代码。这样,我们就能节能自己优化代码的时间。源代码中的FFT是基—2算法。-By calling the quartus ii macro module, optimize the source code.so,we can save the time to optimize the source code by yourself.This code is base-2 of FFT algorithm,a simple algorithm to r
sqrt
- FPGA的一个IP内核,用来优化除法算法的源代码包。-An FPGA IP cores to optimize the division algorithm source code package.
LDPC码编译码算法的研究与实现_陈石平
- 本文首先回顾了LDPC码的发展历程和现状,介绍了LDPC码检验矩阵的构造、编 译码原理。在对编译码作了深入探讨和分析后,接着进行了RU算法编码和长码编码 的FPGA实现;根据二叉树的性质,提出了一种长码编码的ASIC优化设计的方法,节省 了大量硬件资源;论文详细阐述了CORDIC算法原理以及LDPC码译码中所采用的指 数函数和反双曲正切函数的FPGA实现:CORDIC内核及前后处理单元设计、仿真、综 合及数据分析,这对LDPC码的译码具有很重要的意义,为用数字VLSI来实现LDPC的